说明:This a verilog code for FIR filter works good on linux and windows platform-This is a verilog code for FIR filter works good on linux and windows platform <prad> 在 2024-12-24 上传
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说明:原创协处理模型,异步并行接口,verilog实现,可作为仿真testbench用
-Co-processing model, asynchronous parallel interface, verilog achieve, can be used as a simulation testbench <derek> 在 2024-12-24 上传
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说明:24位数据转化为SPI指令,注释详细,位宽可自行更改,适用于多位数据转化为串行数据,实测可用-For SPI instructions, detailed notes, bit width can be self change, applicable to a number of data conversion for the serial data can be measured 24 bit data transformation <wanglei> 在 2024-12-24 上传
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说明:时钟分频功能模块,采用计数器后两位异或再移位的方式实现,节约资源。-Clock divider function module, after using two different counter or re-shift ways to save resources. <小白> 在 2024-12-24 上传
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说明:基于verilog的2ASK调制的程序,调试通过,有需要可以下载来参考-Based verilog of 2ASK modulation process, debugging through, there is a need to download reference <yangdong> 在 2024-12-24 上传
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说明:基于verilog的QPSK调制的程序,调试通过,有需要可以下载来参考-QPSK modulation-based verilog procedures, debugging through, there is a need to reference download <yangdong> 在 2024-12-24 上传
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说明:基于verilog的QPSK解调的程序,调试通过,有需要可以下载来参考-Based on the QPSK demodulator verilog procedures, debugging through, there is a need to download reference <yangdong> 在 2024-12-24 上传
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