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[VHDL编程self-drink-seller-verilog-code

说明:饮料自动售卖机的verilog代码,实现各种情况下饮料的购买-self-drink seller verilog code
<徐以为> 在 2024-11-13 上传 | 大小:1kb | 下载:0

[VHDL编程seria-to-parallel

说明:主要用来实现数据串并转换功能,内附2种实现程序-serial to parallel converter verilog code
<徐以为> 在 2024-11-13 上传 | 大小:1kb | 下载:0

[VHDL编程telephone-cost-metering

说明:该程序用来实现电话计时以算取费用,比较简单-telephone cost metering verilog code
<徐以为> 在 2024-11-13 上传 | 大小:1kb | 下载:0

[VHDL编程servo

说明:Verilog编写的辉盛9g舵机控制程序,clk:25MHz,输入角度(0~180),输出PWM,直接连到舵机引脚上即可使用-Verilog prepared Fraser 9g servo control procedures, clk: 25MHz, input angle (0 to 180), the output PWM, directly connected to the steering pin can be used
<张立嘉> 在 2024-11-13 上传 | 大小:1kb | 下载:0

[VHDL编程cpld_read_adc

说明:在可编程逻辑器件cpld里读8通道模数转换器adc的值-themodule read the value of 8 channels ADC in cpld
<jimmy> 在 2024-11-13 上传 | 大小:1kb | 下载:0

[VHDL编程Altera-FPGA_CPLD-Design

说明:Altera FPGA/CPLD设计(基础篇),非常好的 FPGA入门教程-Altera FPGA/CPLD design (Basics), very good FPGA Tutorial
<李洁> 在 2024-11-13 上传 | 大小:1kb | 下载:0

[VHDL编程iicslave

说明:iic代码 这个是作为从机是接受数据是没有问题的 我已经验证过是可以用的额 -iic this communication code fpga have a slave ,the code test ok
<王宁> 在 2024-11-13 上传 | 大小:1kb | 下载:0

[VHDL编程multi_booth

说明:verilog编写的booth算法的8x16乘法累加器-verilog prepared booth algorithm 8x16 multiplier-accumulator
<chrisxu> 在 2024-11-13 上传 | 大小:1kb | 下载:0

[VHDL编程mult

说明:verilog编写的8x16常变量乘法器,可用quartus仿真-verilog prepared 8x16 often variable multiplier, available quartus simulation
<chrisxu> 在 2024-11-13 上传 | 大小:1kb | 下载:0

[VHDL编程MtoNgencount

说明:Consider a counter that counts from m to n and then wraps around. Derive HDL code for the counter. Use generics, M and N, for m and n of the counter.(Note: there should be one control as UP/DOWN such that when UP/DOWN=1
<Aftab Rai> 在 2024-11-13 上传 | 大小:1kb | 下载:0

[VHDL编程serialtoparellel

说明:Write a HDL Code to use as a serial to parallel converter
<Aftab Rai> 在 2024-11-13 上传 | 大小:1kb | 下载:0

[VHDL编程parallel8_serial

说明:V5 FPGA中8:1并串转换输出,可供初学者参考设计,涉及 OSERDES 原语的使用-the use of "OSERDES"
<lkg> 在 2024-11-13 上传 | 大小:1kb | 下载:0
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