[VHDL编程] lpm_inv0

说明：自己编写的vhdl语言来实现的lpm_inv0电路，自我感觉还可以，也通过了编译，如果有需要就下载去看看吧-prepared vhdl own language to achieve the lpm_inv0 circuit, but also a sense of self, also passed the compiler, if there is a need to look at the downloaded Look here
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[VHDL编程] 74138_0

说明：这是老师给的3—8译码器的源程序，自己刚才调试过了，真的成功了，哈哈……，有需要就看看吧-This the teacher for the 3-8 decoder source, have their own testing before, and really successful, ha ha ... there is a need to watch it!
<wenjun> 在 2024-10-15 上传 | 大小：1024 | 下载：0

[VHDL编程] 4_10_vhdl

说明：这是老师给但计数器程序，经过自己刚才调试过了，真的成功了，哈哈……，有需要就看看吧-This the teacher but to counter procedures, testing himself just over a really successful, ha ha ... there is a need to watch it!
<wenjun> 在 2024-10-15 上传 | 大小：1024 | 下载：0

[VHDL编程] ModelSim_TestBench_VHDL

说明：ModelSim TestBench的VHDL模版-ModelSim VHDL template TestBench
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[VHDL编程] N_counter_VHDL

说明：任意N进制分频器的标准VHDL代码（原创）-arbitrary N divider 229 standard VHDL code (original)
<汤维> 在 2024-10-15 上传 | 大小：1024 | 下载：0

[VHDL编程] PulseWidth_detector_VHDL

说明：通信控制中常用的脉冲宽度检测程序，VHDL模块化编成实现（原创）-communication control used in pulse width detection procedures, VHDL modular organization to achieve (original)
<汤维> 在 2024-10-15 上传 | 大小：1024 | 下载：0

[VHDL编程] even_divider_VHDL

说明：常用2、4、6及任意偶数分频器的VHDL代码实现（原创）-used 2,4,6 and even arbitrary divider VHDL code to achieve (original)
<汤维> 在 2024-10-15 上传 | 大小：1024 | 下载：0

[VHDL编程] odd_divider_VHDL

说明：常用1、3、5及任意奇数分频器的VHDL代码实现（原创）-used 1,3,5 and arbitrary odd Divider VHDL code to achieve (original)
<汤维> 在 2024-10-15 上传 | 大小：1024 | 下载：0

[VHDL编程] 9.8_DISP256_GUO

说明：基于Verilog-HDL的硬件电路的实现 9.8 基于256点阵的汉字显示 　　9.8.1 单个静止汉字显示的设计原理及其仿真实现 　　9.8.2 单个静止汉字显示的硬件实现 　　9.8.3 多个静止汉字显示的设计原理及其硬件实现 　　9.8.4 单个运动汉字显示的设计原理及其硬件实现 　　9.8.5 多个运动汉字显示的设计原理及其硬件实现 -based on Verilog-HDL hard
<宁宁> 在 2024-10-15 上传 | 大小：1024 | 下载：0

[VHDL编程] 070330

说明：VHDL三分频程序 VHDL三分频程序-VHDL third frequency procedures VHDL third frequency procedures VHDL third frequency procedures
<沈旭东> 在 2024-10-15 上传 | 大小：1024 | 下载：0

[VHDL编程] FIR_beh

说明：FIR滤波器的行为级VHDL源代码，可以任意修改滤波器级数，滤波器系数的精度为16比特。-FIR filter behavioral VHDL source code, which could be amended filter series. The filter coefficients for the 16-bit accuracy.
<郭兴波> 在 2024-10-15 上传 | 大小：1024 | 下载：0

[VHDL编程] ADC_16bit

说明：用verilog硬件描述语言编写的16位数模转换器的源代码，可以综合-with verilog hardware descr iption language of 16 Digital to Analog source code can be integrated
<awp> 在 2024-10-15 上传 | 大小：1024 | 下载：0