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[VHDL编程] design-a-clk-system-by-verilogHDL
说明:利用verilog语言描述的具有调时、定时、闹钟、报时等功能的时钟系统-Verilog language to describe the use of a tune, time, alarm clock, timer and other functions of the clock system<张方圆> 在 2024-11-20 上传 | 大小:2kb | 下载:0
[VHDL编程] Verilog-FIFO
说明:可综合的Verilog FIFO存储器,可以实现先如先出的设计-Synthesizable Verilog FIFO memory can be as-first-out design<白白> 在 2024-11-20 上传 | 大小:2kb | 下载:0
[VHDL编程] calculator
说明:多功能计算器:通过键盘输入,可实现两位数的加减运算,带有进位,借位。-Multi-function calculator: The keyboard can be achieved double-digit addition and subtraction with carry, borrow.<HWZ> 在 2024-11-20 上传 | 大小:2kb | 下载:0
[VHDL编程] xujuxuanzhe
说明:还用硬件描述语言设计的数据选择器,现代逻辑器件-Also designed using hardware descr iption language data selector, modern logic devices<罗风> 在 2024-11-20 上传 | 大小:2kb | 下载:0
[VHDL编程] jiemaqi
说明:基于FPGA的数字解码器的的vhdl代码-FPGA-based digital decoder in vhdl code<jialiangquan> 在 2024-11-20 上传 | 大小:2kb | 下载:0
[VHDL编程] MIPS-Parts
说明:// * Data Memory and IO: This is the data memory, and some IO hardware // * 8x16 register file: eight 16-bit registers // * 16-bit ALU // * 2:1 16-bit Multiplexer // * Sign extender from 7 to 16 bits // * 4:1 1<Billy Bob> 在 2024-11-20 上传 | 大小:2kb | 下载:0
[VHDL编程] 8051_Serial_INT_RECEIVE
说明:8051 Assembler using Serial Receive Interrupt<Afonso> 在 2024-11-20 上传 | 大小:2kb | 下载:0