[VHDL编程] cpu_hazard

说明：cpu的开发流程，包括hazard的处理，我课程作业的大作业，还是有参考价值的-cpu development process, including the hazard of handling large jobs my course work, or a reference value
<祝> 在 2025-04-25 上传 | 大小：4kb | 下载：0

[VHDL编程] 2-button-pong

说明：This a game which can be play with 2 player pong game -This is a game which can be play with 2 player pong game
<kubra> 在 2025-04-25 上传 | 大小：1.16mb | 下载：0

[VHDL编程] VDMA

说明：zynq7000平台上的vdma应用实例，适用于PL部分到 PS部分的高速图像传输。-vdma example on zynq7000， which is very useful to image communications between PL and PS
<haytress> 在 2025-04-25 上传 | 大小：297kb | 下载：0

[VHDL编程] xapp1246-multiboot-bpi

说明：K7芯片 多核BPI BOOT源代码以及PDF说明-K7 chip multi-core BPI BOOT source code and PDF descr iption
<徐斯文> 在 2025-04-25 上传 | 大小：6.12mb | 下载：0

[VHDL编程] QPSK_v

说明：1-bit QPSK code for verilog.
<Kashif> 在 2025-04-25 上传 | 大小：100kb | 下载：0

[VHDL编程] DIGITAL-PID

说明：Use verilog language design DIGITAL-PID source
<磊> 在 2025-04-25 上传 | 大小：1010kb | 下载：0

[VHDL编程] 20161227_sf

说明：AES加密算法中的列混合模块的FPGA实现源代码，采用Verillog语言，在软件Quartus II上综合-AES encryption algorithm in the FPGA column hybrid module implementation source code, using language Verillog integrated in the Quartus II software
<柳广兴> 在 2025-04-25 上传 | 大小：129kb | 下载：0

[VHDL编程] 20161122_ff

说明：MD5认证部分的第一轮中包含F函数的一次操作的FPGA实现源代码，采用Verilog，在Quartus II上综合-MD5 authentication part of the first round contains an F function of the operation of the FPGA implementation of the source code, using Verilog, integrated in the
<柳广兴> 在 2025-04-25 上传 | 大小：319kb | 下载：0

[VHDL编程] 20161122_gg

说明：MD5认证部分的第二轮中包含G函数的一次操作的FPGA实现源代码，采用Verilog，在Quartus II上综合-FPGA contains one operation in the second round of the G function MD5 authentication component implementation source code, using Verilog, synthesis in Quartus II
<柳广兴> 在 2025-04-25 上传 | 大小：314kb | 下载：0

[VHDL编程] 20161203_hh

说明：MD5认证部分的第三轮中包含H函数的一次操作的FPGA实现源代码，采用Verilog，在Quartus II上综合-FPGA third round included H functions in one operation MD5 authentication component implementation source code, using Verilog, synthesis in Quartus II
<柳广兴> 在 2025-04-25 上传 | 大小：289kb | 下载：0

[VHDL编程] 20161203_ii

说明：MD5认证部分的第四轮中包含I函数的一次操作的FPGA实现源代码，采用Verilog，在Quartus II上综合-The fourth round MD5 authentication section contains FPGA one operation I Functions of the source code, using Verilog, synthesis in Quartus II
<柳广兴> 在 2025-04-25 上传 | 大小：301kb | 下载：0

[VHDL编程] TEST1

说明：在本实验中，用三个按键开关来表示 1 位全加器的三个输入（ Ai、 Bi、 Ci）； 用二个 LED 来表示 1 位全加器的二个输出（ Si， C）。通过输入不同的值来观察输 入的结果与 1 位全加器的真值表（表 1-1）是否一致。-In this experiment, three button switches to represent three input a full adder (Ai, Bi, Ci) two b
<小方> 在 2025-04-25 上传 | 大小：273kb | 下载：0