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[VHDL编程] AudioDelay_12bit
说明:Experimental digital ADC and audio delay using VHDL on Spartan3E 500k<Aloy AI X> 在 2024-11-13 上传 | 大小:705kb | 下载:0
[VHDL编程] eda-2014020904002
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说明:Verilog数字时钟,已实现Diamond环境仿真与FPGA硬件测试-Verilog digital clock, has achieved Diamond FPGA hardware simulation and test environment<陈弘舟> 在 2024-11-13 上传 | 大小:501kb | 下载:0