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[VHDL编程VIVADO 从此开始-2017.1-265_14090262

说明:VIVADO 从此开始,详细讲解了vivado,FPGA开发工具的使用,对于初学者学习VIVADO工具很有用。(VIVADO from now on, explained in detail the use of vivado, FPGA development tools, for beginners to learn VIVADO tools very useful.)
<01121100 > 在 2025-04-30 上传 | 大小:32.91mb | 下载:1

[VHDL编程the example of FPGA principle and application

说明:该文件为特权同学FPGA开发板打造的同步练习,里面有详细的例程和操作步骤。(The document for the privileged students FPGA development board to create synchronized exercises, which have detailed routines and steps.)
<derit > 在 2025-04-30 上传 | 大小:295kb | 下载:1

[VHDL编程help_lib

说明:1.JESD204B协议 2.Xilinx的JESD204B phy 核手册 3.Xilinx的JESD204B rx_tx 核手册7.1 4.Xilinx的JESD204B rx_tx 核手册7.2 5.verilog实现串口发送(1.JESD204B protocol 2.Xilinx JESD204B PHY core manual 3.Xilinx JESD204B rx_tx core manual 7.1 4.
<Nanke42 > 在 2025-04-30 上传 | 大小:6.69mb | 下载:1

[VHDL编程SMG

说明:实现将BCD码动态扫描显示在数码管上--verilog(The realization of dynamic scanning BCD code displayed on the digital tube --verilog)
<Yukioooo > 在 2025-04-30 上传 | 大小:3kb | 下载:1

[VHDL编程rdf0028

说明:Multiboot on Xilinx SP605
<aguilarjp > 在 2025-04-30 上传 | 大小:906kb | 下载:1

[VHDL编程FFT_Module

说明:接收机数字部分FFT模块的代码 包括verilog代码、 matlab仿真、 word文档 testbench 实现FFT(The code of the digital part FFT module of the receiver Including Verilog, matlab simulation, testbench Implementation of FFT)
<nokkk > 在 2025-04-30 上传 | 大小:5.72mb | 下载:1

[VHDL编程Orthogonization_Module

说明:接收机数字部分正交混频模块‘ 包括verilog代码 matlab仿真 word文档 testbench代码(Receiver digital part orthogonal frequency mixing module ' Including Verilog code Matlab simulation Testbench code)
<nokkk > 在 2025-04-30 上传 | 大小:1.71mb | 下载:1

[VHDL编程CIC_Filter_Module

说明:数字接收机cic抽取模块 抽取倍数可以选择 包括verilog代码 word文档 matlab仿真 testbench代码(CIC decimation module of digital receiver Extraction multiple can be selected Including Verilog code Word document Matlab simulation Testbench code)
<nokkk > 在 2025-04-30 上传 | 大小:2.87mb | 下载:1

[VHDL编程liushuideng

说明:Cyclone V开发实验板实现FPGA的8位流水灯(Cyclone V development of experimental board to realize 8 bit flow lamp of FPGA)
<wwda > 在 2025-04-30 上传 | 大小:4.18mb | 下载:1

[VHDL编程ahb_sramc_svtb

说明:ahb总线Verilog代码及sv仿真文件(ahb bus Verilog code and sv simulation code)
<逐末 > 在 2025-04-30 上传 | 大小:81kb | 下载:1

[VHDL编程FPGA verilog代码

说明:ad转换模块hx711用FPGA的驱动实现(hx711 FPGA aaaaaaaaaaaa)
<棨戟kv > 在 2025-04-30 上传 | 大小:380kb | 下载:1

[VHDL编程i2s

说明:用Verilog实现的i2s功能,支持24bit的左右声道 接收和发送。左对齐,延迟1拍。(I2S module, Verilog I2S, up to 24-Bit Data Data Valid on Rising Edge of SCLK)
<zlh840 > 在 2025-04-30 上传 | 大小:8kb | 下载:1
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