[VHDL编程] uP

说明：这是8位微处理器的Verilog源代码，可以欠在Flex10k10里面-This is the 8-bit microprocessor Verilog source code, can they owed in Flex10k10
<李无志> 在 2024-10-05 上传 | 大小：95232 | 下载：0

[VHDL编程] DW8051

说明：大名鼎鼎的Synopsys公司出的8051IP Core VHDL语言编写，能被keilC51支持-famous Synopsys Core 8051IP the VHDL language, can be supported keilC51
<李无志> 在 2024-10-05 上传 | 大小：664576 | 下载：0

[VHDL编程] tiny16cpu_maxII

说明：这个是专门用在ALtera第二代PLD MAXII上的16位微处理器IP核，文档齐全-this is the ALtera devoted second-generation PLD MAXII on the 16-bit microprocessor IP core, complete documentation
<李无志> 在 2024-10-05 上传 | 大小：240640 | 下载：0

[VHDL编程] i2c_cores

说明：IIC总线协议，VHDL语言编写，可以直接使用-IIC bus protocol, VHDL language can be used directly
<李无志> 在 2024-10-05 上传 | 大小：20480 | 下载：0

[VHDL编程] manchester_verilog

说明：这时manchesite编码，VERILOG语言，VHDL的找本站我发的帖子-manchesite time coding, VERILOG language, VHDL I find a site in a posting
<李无志> 在 2024-10-05 上传 | 大小：9216 | 下载：0

[VHDL编程] alu

说明：硬件设计vhdl_cpu1,1. You may copy and distribute verbatim copies of this core, as long -- as this file, and the other associated files, remain intact and -- unmodified. Modifications are outlined below.-hardware design vhdl_
<江浩> 在 2024-10-05 上传 | 大小：1024 | 下载：0

[VHDL编程] idec

说明：2. You may use this core in any way, be it academic, commercial, or -- military. Modified or not.-2. You may use this core in any way, be it academic, commercial, or-- military. Modified or not.
<江浩> 在 2024-10-05 上传 | 大小：2048 | 下载：0

[VHDL编程] regs

说明：3. Distribution of this core must be free of charge. Charging is -- allowed only for value added services. Value added services -- would include copying fees, modifications, customizations, and -- inclusion in other prod
<江浩> 在 2024-10-05 上传 | 大小：2048 | 下载：0

[VHDL编程] dram

说明：4. If a modified source code is distributed, the original unmodified -- source code must also be included (or a link to the Free IP web -- site). In the modified source code there must be clear -- identification of the m
<江浩> 在 2024-10-05 上传 | 大小：1024 | 下载：0

[VHDL编程] 1032yiwei_new

说明：CPLD LATTICE1032测试模式代码-CPLD LATTICE1032 test model code
<冯达> 在 2024-10-05 上传 | 大小：2048 | 下载：0

[VHDL编程] FIR低通滤波器部分模块

说明：一个FIR低通滤波器,最小阻带衰减-30db,带内波动小于1db．用MAXPLUS2设计与仿真。-This is a FIR LPF, with-30dB in stop-band and sigma is less than 1dB. It is designed and simulated on MAXPLUS2.
<吴健宇> 在 2024-10-05 上传 | 大小：5120 | 下载：0

[VHDL编程] 数字电子钟

说明：数字电子钟 此数字电子钟具有的功能包括： 1. 计时，时、分、秒显示； 2. 十二小时与二十四小时之间的转换； 3. 上下午显示； 4. 对时、分、秒的校时功能； 5. 跑表功能。-digital electronic clock this digital electronic clock with functions include : 1. Time, hours, minutes and seconds display; 2. 1
<吴健宇> 在 2024-10-05 上传 | 大小：7168 | 下载：0