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[VHDL编程Lab09

说明:LabVIEW FPGA Implementation of Adaptive Filtering
<a800005217> 在 2024-12-24 上传 | 大小:1.41mb | 下载:1

[VHDL编程ethernet-verilog

说明:非常详细的千兆以太网MAC verilog代码,可以供硬件设计时有关网络的开发参考-Very detailed Gigabit Ethernet MAC verilog code, can be used for hardware design of the network to develop a reference
<瞿鑫> 在 2024-12-24 上传 | 大小:688kb | 下载:1

[VHDL编程ADS830

说明:幅频均衡数字滤波器设计,ad830输入,800阶的FIR滤波,采用电阻网络DA输出,效果很好-Amplitude-frequency equalization of digital filter design, ad830 input, 800 order of FIR filter, using DA output resistance network, the effect is very good
<十禅> 在 2024-12-24 上传 | 大小:18.12mb | 下载:1

[VHDL编程fib

说明:一个基于VHDL编程的可用于FPGA实现的斐波那契数列计算器- implemented a circuit in VHDL that calculates Fibonacci numbers
<andyxing> 在 2024-12-24 上传 | 大小:6kb | 下载:1

[VHDL编程dianziqin

说明:主要使用Basys2开发板,Verilog语言,外接PS2键盘,来实现电子琴的发音及歌曲演奏-The digital piano uses Basys2 development board, Verilog language, external PS2 keyboard, to realize sound and play songs
<白净> 在 2024-12-24 上传 | 大小:28kb | 下载:1

[VHDL编程PCF8591VHDL-CODE

说明:PCF8591vhdl语言实现,能实现对8591的控制及数据采集。-PCF8591vhdl language, to achieve the 8591 control and data acquisition.
<zhao> 在 2024-12-24 上传 | 大小:4.01mb | 下载:1

[VHDL编程DE0_VGA

说明:利用FPGA设计游戏设计,真人版超级玛丽,VGA显示-Using FPGA design game design, live-action version of Super Mario, VGA display
<limin> 在 2024-12-24 上传 | 大小:310kb | 下载:1

[VHDL编程RISC-CPU

说明:精简指令集 CPU 通过仿真验证正确 (使用之前务必看readme文件,和结构图!) 1. 此cpu是夏宇闻 verilog数字系统设计教程中最后一章的例程。 2. 学习时务必先搞明白框图原理,和数据流动!!! 3. 牢记主状态机中一条指令周期中传输的16bit=3bit指令+13bit地址。 4. 理解数据总线,和地址总线。区分数据和地址。 5. 仔细调试,因为书中有很多小错误。 程序经过quartu
<刘栋> 在 2024-12-24 上传 | 大小:4.14mb | 下载:1

[VHDL编程ad5791

说明:在Quartus环境下编写,使用Cyclong系列芯片,配置七通道高精度AD5791,该例子为AD5791的FPGA配置使能代码,包括模拟数据输入模块,复位模块,命令接收是能配置模块。-AD5781,Digital signal convert to Analog signal
<Welson> 在 2024-12-24 上传 | 大小:5kb | 下载:1

[VHDL编程vga_automove_img

说明:VGA输出的图像,可以使图片在屏幕上自动碰撞移动。硬件语言-The VGA output image, the picture on the screen automatic collision mobile. Hardware language
<李晶> 在 2024-12-24 上传 | 大小:2.32mb | 下载:1

[VHDL编程chu_avalon_audio

说明:avalon sopc audio interface coding
<Ramanathan.SP.> 在 2024-12-24 上传 | 大小:5kb | 下载:1

[VHDL编程mode3by3_generate_module

说明:用verilog编写的3x3模块!用于图像处理算法中的中值滤波和边缘检测等等!-failed to translate
<张皓> 在 2024-12-24 上传 | 大小:912kb | 下载:1
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