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[VHDL编程] FPGA_signal_general
说明:摘 要:介绍了直接数字频率合成 (DDS) 技术的基本原理,给出了基于Altera公司FPGA器件的一个三相正弦信号发生器的设计方案,同时给出了其软件程序和仿真结果。仿真结果表明:该方法生成的三相正弦信号具有对称性好、波形失真小、频率精度高等优点,且输出频率可调。 关键词:直接数字频率合成;现场可编程门阵列;FPGA;三相正弦信号-Abstract: Direct Digital Synthesis (DDS) technology<赵文> 在 2024-11-18 上传 | 大小:99kb | 下载:0
[VHDL编程] vcs_simulation_mannual(Edition2)
说明:VCS-verilog compiled simulator是synopsys公司的产品.其仿真速度相当快,而且支持多种调用方式.该文档是一个不错的使用指南.-VCS-verilog compiled simulator is the Synopsys company s products. Its simulation at a fairly rapid pace, and support multiple call mode. Th<morisun> 在 2024-11-18 上传 | 大小:174kb | 下载:0
[VHDL编程] Xilinx_FPGA
说明:介绍了FPGA设计全流程:Modelsim>>Synplify.Pro>>ISE-Introduced the entire FPGA design process: Modelsim>> Synplify.Pro>> ISE<chencheng> 在 2024-11-18 上传 | 大小:213kb | 下载:0
[VHDL编程] TranslateToUTOPIA
说明:VHDL写一个转换到utopia接口的转换源程序.可以进行utopia接口的仿真试验-VHDL to write a converter to convert source utopia interface. Can utopia interface simulation test<falcon_cq> 在 2024-11-18 上传 | 大小:2kb | 下载:0