[VHDL编程] FIFO

说明：VHDL code for first in first out register
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[VHDL编程] Desktop

说明：VHDL code for 16 byte ROM & n bit comparator & a full adder
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[VHDL编程] mux_reg

说明：VHDL code for a multiplexer and a parallel/serial in parallel/serial out shift register
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[VHDL编程] stoplight

说明：VHDL code for a 4 state stop light with police control input
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[VHDL编程] BCD_adder

说明：VHDL code for a one bit comparator and an n bit register and a BCD adder
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[VHDL编程] tristate

说明：VHDL code for a full adder and n bit full adder a tri state buffer and a flip flop
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[VHDL编程] alarm

说明：（1）：最基本的时间设定与校准功能； （2）：闹钟定时功能，以及闹钟响铃功能； （3）：一定条件下可以实现闹钟的时间自动修改功能； （4）：当前时间为整点时实现整点报时功能。 （5）：定时显示与计时显示可以实现任意切换 -(1): the most basic function of time for setup and calibration (2): clock timing, as well as the
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[VHDL编程] fp

说明：
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[VHDL编程] Pld_lab4

说明：stop watch in vhdl using MAXII development board.
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[VHDL编程] counter

说明：实现了各种精度的计算器，可供学习，也可应用的工程中。- the difference counter ,it can help to learn VHDL ,it can also be as a modular in your project
<xu_xf> 在 2025-04-25 上传 | 大小：1kb | 下载：0

[VHDL编程] rs_enc

说明：这是一个用VHDL编写的RS信道编码程序-This is a VHDL prepared with RS channel coding procedures
<chenxiaoming> 在 2025-04-25 上传 | 大小：1kb | 下载：0

[VHDL编程] tcm_enc

说明：这是一个用VERILOG HDL 编写的TCM信道编码-This is a VERILOG HDL prepared with TCM channel coding
<chenxiaoming> 在 2025-04-25 上传 | 大小：1kb | 下载：0