[VHDL编程] 8b10b_endecode

说明：8b转10b的编码和解码程序，已验证。ALTERA官方代码，有编码和解码两个文件-an 8b10b decoder, based on files Martin R and IBM paper
<adfadf> 在 2024-10-10 上传 | 大小：9216 | 下载：0

[VHDL编程] X4_8B10B

说明：4倍转换率的8b转10b的编码和解码程序，已验证。ALTERA官方代码，有编码和解码两个文件-8b 4 times the conversion rate of turn 10b encoding and decoding procedures have been verified. ALTERA official code, encoding and decoding two files
<adfadf> 在 2024-10-10 上传 | 大小：4096 | 下载：0

[VHDL编程] crc

说明：用于ethernet的CRC校验源代码，ALTERA官方代码，已验证-CRC checksum of the source code for ethernet, ALTERA official code, verified
<adfadf> 在 2024-10-10 上传 | 大小：3072 | 下载：0

[VHDL编程] verilog_uart

说明：verilog编写的uart源代码，altera官方代码，已验证-verilog prepared uart source code, altera official code, verified
<adfadf> 在 2024-10-10 上传 | 大小：4096 | 下载：0

[VHDL编程] double_addsub

说明：双字的加减法的verilog源代码和testbench，已经过测试-verilog source code and testbench double word addition and subtraction, and has been tested
<adfadf> 在 2024-10-10 上传 | 大小：3072 | 下载：0

[VHDL编程] pipeline_add

说明：pipeline式累加器的verilog代码和testbench文件，已验证-pipeline type accumulator verilog testbench code and documents, verified
<adfadf> 在 2024-10-10 上传 | 大小：4096 | 下载：0

[VHDL编程] UD_DIVDER

说明：定制化分频器的verilog源代码，分频器变量已参数化，好用-Customized divider verilog source code, variable frequency divider parameterized, easy to use
<adfadf> 在 2024-10-10 上传 | 大小：3072 | 下载：0

[VHDL编程] gray_counter

说明：altera官方格雷码计数器的verilog代码和testbench,已测试-altera official Gray code counter verilog code and testbench, have been tested
<adfadf> 在 2024-10-10 上传 | 大小：5120 | 下载：0

[VHDL编程] parall_interf

说明：SPI是串行外设接口(Serial Peripheral Interface)的缩写。SPI，是一种高速的，全双工，同步的通信总线，并且在芯片的管脚上只占用四根线，节约了芯片的管脚，同时为PCB的布局上节省空间-Serial Peripheral Interface
<李长兴> 在 2024-10-10 上传 | 大小：1024 | 下载：0

[VHDL编程] design

说明：浮点数是属于有理数中某特定子集的数的数字表示，在计算机中用以近似表示任意某个实数。-Floating point numbers are rational numbers belonging to a particular subset of the digital representation for an approximate representation of any real number in the computer.
<李长兴> 在 2024-10-10 上传 | 大小：2048 | 下载：0

[VHDL编程] ADC_READ

说明：读取 模数转换器的数据 把读来的数据存在FIFI中-ADC read，Einlesen der Daten von ADC-Wandler dann in FIFO Speichern
<Aaron> 在 2024-10-10 上传 | 大小：1024 | 下载：0

[VHDL编程] top_clock-plus

说明：在quartus ii上仿真24小时的时钟在输入基本的时钟信号后，秒数，分数，小时数的变化-After entering the basic clock signal, seconds, fractions, changes in the number of hours of simulation on a 24-hour clock quartus ii
<bajie> 在 2024-10-10 上传 | 大小：1593344 | 下载：0