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[VHDL编程] ps2_keyboard
说明:VErilog编写的PS2键盘读写源码 模块端口的列表: clk, reset, ps2_clk, ps2_data, rx_extended, rx_released, rx_shift_key_on, rx_scan_code, rx_ascii, rx_data_ready, // rx_read_o rx_read, // rx_read_ack_i<> 在 2025-02-06 上传 | 大小:7kb | 下载:0
[VHDL编程] UART-SPI-I2C-VGA
说明:里面有i2c,uart,spi的代码,也是从别的地方下的觉得还不错,,与大家分享一下,做个参考-I2c, uart, spi code inside, but also from elsewhere feel pretty good, and we share with you, to be a reference<娃娃> 在 2025-02-06 上传 | 大小:493kb | 下载:0
[VHDL编程] num_clock-www.21ic.com
说明:可以在FPGA板上实现数钟的整点报时,闹钟等功能-num_clock 21ic.com<林哒哒> 在 2025-02-06 上传 | 大小:2.4mb | 下载:0
[VHDL编程] fpga_UDP_NET
说明:fpga驱动dm9000,通过网口向上位机发送数据。底层为verilog,上层Nios为c。-fpga driver dm9000, send data through the network port up crew. The underlying verilog, upper Nios c.<chensheng> 在 2025-02-06 上传 | 大小:25.38mb | 下载:0
[VHDL编程] uart_send5bytes
说明:CPLD实现串口发五个字节,有校验,验证可用。注释明了-CPLD realization of the serial transceiver five bytes, verification, validation available. Note clear<杨蕾> 在 2025-02-06 上传 | 大小:3kb | 下载:0
[VHDL编程] uart_receive5bytes
说明:C语言实现CPLD串口接受五个字节,有校验,检验无效不做处理,接续检测接受,注释详细。-C language CPLD five byte serial accept check, test invalid without processing, splice detection to accept detailed notes.<杨蕾> 在 2025-02-06 上传 | 大小:2kb | 下载:0
[VHDL编程] hdsdi_crc2
说明:xilinx virtex5 HDSDI_crc码-HDSDI_crc code<wujunlin> 在 2025-02-06 上传 | 大小:2kb | 下载:0
[VHDL编程] triple_sdi_rx
说明:XILINX VIRTEX5 triple_SDI接受端-XILINX VIRTEX5 triple_SDI receiving end<wujunlin> 在 2025-02-06 上传 | 大小:12kb | 下载:0
[VHDL编程] trs_detect
说明:xilinx virtex5 sdi 定时基准码检测-xilinx virtex5 sdi timing reference code detection<wujunlin> 在 2025-02-06 上传 | 大小:3kb | 下载:0
[VHDL编程] v5gtp_sdi_rx_reset
说明:xilinx virtex5 sdi复位控制-the xilinx virtex5 sdi reset control<wujunlin> 在 2025-02-06 上传 | 大小:3kb | 下载:0