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[VHDL编程xilinx_lib.tar

说明:用于modelsim仿真的xilinxfpga平台IP库,以ise 13.x为基础制作,在modelsim10下验证通过。(xilinx IP core library for modelsim simulate, based on ise 13.x, verified in modelsim10.)
<asmreg > 在 2024-11-10 上传 | 大小:15.4mb | 下载:0

[VHDL编程MAKEAMIF

说明:用于生成xilinx开发环境中存储器ip core的mif数据文件的程序代码。(this program is used to generate mif file used by xilinx memory ip core.)
<asmreg > 在 2024-11-10 上传 | 大小:4kb | 下载:0

[VHDL编程MAKEXCOE

说明:用于生成xilinx开发环境中存储器ip core的coe数据文件的程序代码。(this program is used to generate coe file used by xilinx memory ip core.)
<asmreg > 在 2024-11-10 上传 | 大小:4kb | 下载:0

[VHDL编程crc8_8_serial

说明:自己编写的高效8位输入串行CRC-8 ATM程序(an effective program for 8bit serial input CRC-8 ATM calculate.)
<asmreg > 在 2024-11-10 上传 | 大小:49kb | 下载:0

[VHDL编程bus

说明:公交车系统基于FPGA芯片的基础上,增加了数码管显示模块、语音自动报站模块、红外通信模块。站牌系统采用以FPGA为核心的主控芯片,增加液晶显示模块、红外通信模块、RS232总线模块、指示灯显示模块等。(The bus system is based on FPGA chip. It adds digital tube display module, voice automatic reporting module and infrare
<幽山之隅 > 在 2024-11-10 上传 | 大小:6.4mb | 下载:0

[VHDL编程heartbeat

说明:整个程序由心率传感器模块,体温传感器模块,3D计步器模块,FPGA开发板,A/D转换器,LCD显示屏等组成。(The entire program module by heart rate sensor, temperature sensor module, 3D pedometer module, FPGA development board, A/D converter, LCD display etc..)
<幽山之隅 > 在 2024-11-10 上传 | 大小:16.45mb | 下载:0

[VHDL编程dianziqin

说明:基于FPGA的电子琴动态录音与回放系统在FPGA的基础上设计系统的核心功能模块,再配合相应外围电路,在实现了电子琴基本功能的同时,还增加了演奏音乐的存储功能。(The core function module of FPGA electronic organ dynamic recording and playback system based on FPGA based, together with the corresponding
<幽山之隅 > 在 2024-11-10 上传 | 大小:20.96mb | 下载:0

[VHDL编程irrigation system

说明:基于FPGA和ARM,通过DHT11测量土壤温湿度等传感器,最终达到智能灌溉,并且能在PC机上进行监测,可通过PC来控制灌溉(Based on FPGA and ARM, soil temperature and humidity sensors were measured by DHT11, and finally intelligent irrigation was realized, and it could be monitor
<幽山之隅 > 在 2024-11-10 上传 | 大小:13.88mb | 下载:0

[VHDL编程shumaguan

说明:7断数码管动态显示数字,初学者适用,芯片是MAX II系列的芯片,比较老旧了。(Digital tube display number)
<游子游荡 > 在 2024-11-10 上传 | 大小:173kb | 下载:0

[VHDL编程state_machine

说明:同样是简单的MAX II编程,状态机顾名思义,0到8的循环显示,用到了数码管。(The same is a simple MAX II programming, the state machine as its name suggests, 0 to 8 of the cycle display, using the digital tube.)
<游子游荡 > 在 2024-11-10 上传 | 大小:188kb | 下载:0

[VHDL编程Carry-Skip Adder

说明:经典的进位跳跃、进位选择、并行前缀加法器,16位,基于verilog HDL语言(16-bit carry-skip adder)
<Dirty > 在 2024-11-10 上传 | 大小:1kb | 下载:0

[VHDL编程FuncTest ver1.0

说明:常用FPGA,EP4CE10,经典例程,开发板亲测可用,可用于自学编程(Commonly used FPGA, EP4CE10, classic routines, development board pro test available, can be used for self programming)
<FANS2 > 在 2024-11-10 上传 | 大小:62.9mb | 下载:0
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