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[VHDL编程chufa

说明:二进制除法实现,可实现四位二进制的除法运算-Binary division to achieve, enabling four binary division
<宋关龙> 在 2025-04-26 上传 | 大小:1kb | 下载:0

[VHDL编程FSK

说明:FSK 的FPGA实现,使用verilogHDL语言-FSK in FPGA,using verilogHDL
<leaffloat> 在 2025-04-26 上传 | 大小:1kb | 下载:0

[VHDL编程fpga-chengxu

说明:对扩频通信系统的仿真程序,应用于fpga开发环境下-a simulation of Spread spectrum communication, using for fpga environment
<du yuming> 在 2025-04-26 上传 | 大小:1kb | 下载:0

[VHDL编程afficheur

说明:Allow you to make display on your Spartan-3 Xc3s2-Allow you to make display on your Spartan-3 Xc3s200
<rakotondrasoa> 在 2025-04-26 上传 | 大小:1kb | 下载:0

[VHDL编程VHDL_counter_source_code

说明:VHDL Counter Source Code
<Acount> 在 2025-04-26 上传 | 大小:1kb | 下载:0

[VHDL编程counter_tbw

说明:VHDL Counter Test Bench
<Acount> 在 2025-04-26 上传 | 大小:1kb | 下载:0

[VHDL编程AND_gate

说明:VHDL AND gate source code
<Acount> 在 2025-04-26 上传 | 大小:1kb | 下载:0

[VHDL编程NAND_gate

说明:VHDL NAND gate source code
<Acount> 在 2025-04-26 上传 | 大小:1kb | 下载:0

[VHDL编程OR_gate

说明:VHDL OR gate source code
<Acount> 在 2025-04-26 上传 | 大小:1kb | 下载:0

[VHDL编程DIV2

说明:二分频,占空比,50比50,VHDL语言-Second, frequency, duty cycle, 50 to 50, VHDL language
<王锋> 在 2025-04-26 上传 | 大小:1kb | 下载:0

[VHDL编程async_receiver

说明:verilog语言,RS232异步接收和发送模块-verilog language, RS232 asynchronous receive and transmit modules
<何沐> 在 2025-04-26 上传 | 大小:1kb | 下载:0

[VHDL编程async_transmitter

说明:verilog语言,RS232异步发送模块-verilog language, RS232 asynchronous transmit module
<何沐> 在 2025-04-26 上传 | 大小:1kb | 下载:0
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