[VHDL编程] FIFO

说明：FIFO,双端口数据存储器，实现数据先入先出的存储器件-FIFO, dual port data memory, data FIFO memory device
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[VHDL编程] 8weishujusuocunqi

说明：位数据锁存器，用于存储数据来进行交换，使数据稳定下来保持一段时间不变化，直到新的数据将其替换。 -8-bit data latch for storing data to be exchanged and the data stabilized for a period of time does not change until the new data to replace it.
<清华> 在 2024-11-14 上传 | 大小：1kb | 下载：0

[VHDL编程] jishuqi

说明：各种功能计数器利用数字电路技术数出给定时间内所通过的脉冲数并显示计数结果-Features the use of digital circuit technology a few counters for a given period of time the number of pulses passed by the count and display the results
<清华> 在 2024-11-14 上传 | 大小：1kb | 下载：0

[VHDL编程] boxingfashengqi

说明：波形发生器一种数据信号发生器，在调试硬件时，常常需要加入一些信号，以观察电路工作是否正常-A data signal generator, waveform generator, in the debugging of hardware, it is often necessary to add some signal to observe the circuit is working properly
<清华> 在 2024-11-14 上传 | 大小：1kb | 下载：0

[VHDL编程] i8255

说明：8255的VHDL仿真实现的是串并接口的功能-8255' s VHDL Simulation is the string and the function of the interface
<郭良> 在 2024-11-14 上传 | 大小：1kb | 下载：0

[VHDL编程] 16bitALU

说明：一个16位ALU设计，该ALU主要能实现算术运算(加、减、带进位加、带进位减、加1、减1、传输)、逻辑运算(与、或、非、异或、同或、逻辑左移、逻辑右移操作)。-16bitALU vrilog Code
<Lisa> 在 2024-11-14 上传 | 大小：1kb | 下载：0

[VHDL编程] dpll

说明：dpll is used to lock the data
<jkdgf> 在 2024-11-14 上传 | 大小：1kb | 下载：0

[VHDL编程] recovery

说明：恢复时钟信号的代码,用于数字通信中，used to recovery the timing from data-used to recovery the timing from data
<jkdgf> 在 2024-11-14 上传 | 大小：1kb | 下载：1

[VHDL编程] siqupwm

说明：PWM的死区控制模块CLK delaywave-PWM control module dead
<徐昇龙> 在 2024-11-14 上传 | 大小：1kb | 下载：0

[VHDL编程] Simple_Verilog_Code_For_Beginner

说明：verilog code for beginner (adder, comparator, mux, or, and subtractor)
<abanuaji> 在 2024-11-14 上传 | 大小：1kb | 下载：0

[VHDL编程] transpose_buffer

说明：verilog source code for transpose buffer 8x8 matrics
<abanuaji> 在 2024-11-14 上传 | 大小：1kb | 下载：0

[VHDL编程] RGB_YCrCb_Multiplierless_Color_Converter

说明：verilog source code for RGB YCrCb color converter
<abanuaji> 在 2024-11-14 上传 | 大小：1kb | 下载：0