[VHDL编程] Desktop

说明：crc校验码verilog代码，24bits，按原理写的代码-cyclic redundancy check 24 bits verilog
<陈阳> 在 2024-11-16 上传 | 大小：1kb | 下载：0

[VHDL编程] lcd

说明：FPGA嵌入式开发中的NIOSii的LCD1602控制程序。-FPGA NIOSii LCD1602
<金> 在 2024-11-16 上传 | 大小：1kb | 下载：0

[VHDL编程] 8adder

说明：本实验示例中的8 位二进制并行加法器即是由两个4 位二进制并行加法器级联而成 的图13-4 所示的逻辑电路是由两个并行进位4 位加法器级联而成的8 位二进制加法 器-This is simple adder of 8 by VHDL.
<shuxj> 在 2024-11-16 上传 | 大小：1kb | 下载：0

[VHDL编程] vga_disp

说明：本程序为自己毕业设计用，可通过数据控制VGA显示动态竖彩条，为了使大家容易理解此程序，我对其中关键处作了详细说明，希望对FPGA爱好者和FPGA初学者有用!-The graduate program designed for their own use, data control via dynamic vertical color VGA display section, in order for you easy to unders
<常娟成> 在 2024-11-16 上传 | 大小：1kb | 下载：0

[VHDL编程] fsk

说明：过零检测法设计了一种FSK数字解调器，实现了对FSK数字调制信号的解调，达到了解调的目的-Zero-crossing detection method designed a digital FSK demodulator is realized on the demodulation of FSK digital modulation signals, to understand the purpose of transfer
<朱伟> 在 2024-11-16 上传 | 大小：1kb | 下载：0

[VHDL编程] RS422_receiver

说明：UART--异步串行通讯 接收逻辑 （Verilog）16倍时钟接收-verilog--A UART Receiver 16 clock
<刘通> 在 2024-11-16 上传 | 大小：1kb | 下载：0

[VHDL编程] EDA3

说明：该程序是一个带记数使能，异步复位，带进位输出的增一 二十进制记数器，记数结果由共阴极七段数码管显示-The program is a band count enable, asynchronous reset, into digital output by 12 decimal counter, counting the results from the common cathode seven-segment LED display
<晶晶> 在 2024-11-16 上传 | 大小：1kb | 下载：0

[VHDL编程] eda2

说明：一个带记数使能，同步复位，带进位输出的增一 六位二进制记数器，记数结果由共阴极七段数码管显示-One with a count enable, synchronous reset, into digital output by 16 binary counter, counting the results from the common cathode seven-segment LED display
<晶晶> 在 2024-11-16 上传 | 大小：1kb | 下载：0

[VHDL编程] keyscan_test

说明：针对机械式按键存在的抖动问题，用verilog HDL编写了一个采用防抖方案并对按键次数计数的模块，已经在ISE综合通过！-Keys exist for mechanical jitter, with verilog HDL prepared a program with anti-shake button and count the number of modules have been integrated by ISE!
<tyut> 在 2024-11-16 上传 | 大小：1kb | 下载：0

[VHDL编程] 8jiafaqi

说明：利用此程序可以实现8位超前进位加法器的功能-This program can be used 8-bit look-ahead adder function
<天天> 在 2024-11-16 上传 | 大小：1kb | 下载：0

[VHDL编程] Beverage_machine_controller

说明：VHDL语言实现饮料机的控制，其中顶层电路模块中包含两种饮料控制电路，控制电路以递减计数器为基础。-VHDL language beverage machine control, including top-level circuit module includes two beverage control circuit, control circuit to decrease the counter basis.
<sdfsd> 在 2024-11-16 上传 | 大小：1kb | 下载：0

[VHDL编程] led8_595

说明：使用74595进行8段数码管控制，实现数据显示-Use 74595 for 8 digital control to achieve data
<zhangxinye> 在 2024-11-16 上传 | 大小：1kb | 下载：0