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[VHDL编程taxi-meter-VHDL-design

说明:这是基于VHDL的出租车计价器设计,可以当作来参考。-This is based on the taxi meter VHDL design can be used as to reference.
<猪大> 在 2025-03-16 上传 | 大小:119kb | 下载:0

[VHDL编程Verilog-dalianglic

说明:verilog大量例程,大家可以下载-verilog large number of routines, you can download to see
<redp> 在 2025-03-16 上传 | 大小:119kb | 下载:0

[VHDL编程coded-lock

说明:设计的是一个保险柜的数字锁控制电路。首先最主要的问题是安全,也就是开锁的密码被破译的可能性要尽可能小;其次是操作方便,开锁的程序不过于复杂。此外还有一些特殊要求,例如可预置和更改密码,多次输入错误密码应启动报警系统,使用者在拨错号码时可将原拨号码清除重拨,段码显示等。-Design is a digital safe lock control circuit. First, the main problem is security, t
<张洁> 在 2025-03-16 上传 | 大小:119kb | 下载:0

[VHDL编程AES-algorithm-design

说明:基于FPGA的AES算法芯片设计实现,文中具体给出了测试的运行时间等数据-AES algorithm for FPGA-based chip design to achieve
<menshuang> 在 2025-03-16 上传 | 大小:119kb | 下载:0

[VHDL编程02c_ucf_lab_12-1_gen-only

说明:2010年xinlinx千人大会的资料,关于V6的约束-Thousands of the General Assembly in 2010 xinlinx data constraints on the V6
<王刘> 在 2025-03-16 上传 | 大小:119kb | 下载:0

[VHDL编程use~Verilogtocontrol~FPGASDRAM

说明:介绍了SDRAM的特点和工作原理,提出了一种基于FPGA的SDRAM控制器的设计方法,使用该方法实现的控制器可非常方便地对SDRAM进行控制。-Describes the characteristics and working principle of SDRAM, we propose a FPGA-based SDRAM controller design method, using the method of the contro
<林曉彬> 在 2025-03-16 上传 | 大小:119kb | 下载:0

[VHDL编程Synopsys-tools-intruction

说明:synopsys的主要的工具介绍,包括DC,PT,Formality等,对于初学IC设计者了解设计工具有很大帮助。-synopsys of the main tools for presentations, including DC, PT, Formality, etc., for the beginner tool for IC designers to understand the design of much help.
<rodgersli> 在 2025-03-16 上传 | 大小:119kb | 下载:0

[VHDL编程20080424_soft

说明:Firmware for dimmer. Used triac and zd.
<Ilya> 在 2025-03-16 上传 | 大小:119kb | 下载:0

[VHDL编程demo1-LampsSequencer

说明:实现数字化时钟功能,属于自动化行业的一些源程序-Digital clock function to achieve
<王博> 在 2025-03-16 上传 | 大小:119kb | 下载:0

[VHDL编程key

说明:使用51单片机写的电子密码锁的程序,具有修改密码功能-51 single use of electronic locks to write the program, with a change password function
<liwei> 在 2025-03-16 上传 | 大小:119kb | 下载:0

[VHDL编程16QAM

说明:16QAM fpga vhdl code
<张彬> 在 2025-03-16 上传 | 大小:119kb | 下载:0

[VHDL编程So-you-just-received-an-email-with-an-attachment-

说明:basics verilog code and generation logics
<praha> 在 2025-03-16 上传 | 大小:119kb | 下载:0
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