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[VHDL编程] DividerVHDL
说明:使用VHDL进行分频器设计,主要是一些分频的东西,整数分频,小数分频,奇次分频和偶次分频-Divider using VHDL to design, mainly because some sub-band stuff, integer divider, fractional-N, odd and even sub-sub-sub-sub-band frequency<赵勇涛> 在 2025-03-04 上传 | 大小:315kb | 下载:0
[VHDL编程] VHDL_fre_div
说明:使用VHDL进行分频器设计 本文使用实例描述了在FPGA/CPLD上使用VHDL进行分频器设 计,包括偶数分频、非50 占空比和50 占空比的奇数分频、半整数 (N+0.5)分频、小数分频、分数分频以及积分分频。所有实现均可 通过Synplify Pro或FPGA生产厂商的综合器进行综合,形成可使 用的电路,并在ModelSim上进行验证。-For crossover design using VHDL This<guoguo> 在 2025-03-04 上传 | 大小:315kb | 下载:0
[VHDL编程] scrambler_17
说明:this parallel scrambler verilog code -this is parallel scrambler verilog code<rakhi> 在 2025-03-04 上传 | 大小:315kb | 下载:0
[VHDL编程] Prueba2
说明:lksajhdcla kajsdkjna cwkjelas-laksnc akjshdkj lAKJSKJD LAkhsdkq LKJALKF lkjhaskfnca elsjaf añ ljfa alñ ksjflj. añ djlkajd adffsdg-lksajhdcla kajsdkjna cwkjelas-laksnc akjshdkj lAKJSKJD LAkhsdkq LKJALKF l<sergioarod> 在 2025-03-04 上传 | 大小:315kb | 下载:0
[VHDL编程] 61EDA_D807
说明:VHDL数频分频器设计 整数,奇数,偶数,半数等的分频 -VHDL design of an integer number of frequency divider, odd, even, half of the frequency, etc.<黄家福> 在 2025-03-04 上传 | 大小:315kb | 下载:0