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[VHDL编程Adder

说明:采用HDL语言实现加法操作,可以作为入门的实验例程。-the adder is design by HDL.
<robin> 在 2024-10-10 上传 | 大小:132096 | 下载:0

[VHDL编程Counter

说明:采用HDL语言,实现计数器的功能,这个在程序设计中很常见。-The counter is design by HDL.
<robin> 在 2024-10-10 上传 | 大小:303104 | 下载:0

[VHDL编程Bell

说明:这个是一个驱动蜂鸣器的实验,采用HDL语言编程实现。-The bell code is design by HDL.
<robin> 在 2024-10-10 上传 | 大小:515072 | 下载:0

[VHDL编程CANBus_design

说明:CAN总线代码,除了opencore上的ip核之外,主要是原创的配置CAN核和数据采集传输部分-CAN bus code, in addition to the ip nuclear opencore on the original configuration of CAN main nuclear data acquisition and transmission section
<李阔> 在 2024-10-10 上传 | 大小:114688 | 下载:0

[VHDL编程matlab_for_FPGA_mif_coe

说明:利用matlab生成sin、cos、sinc和insert等mif文件-Using matlab to generate a variety of mif file
<leixiaoqiang> 在 2024-10-10 上传 | 大小:103424 | 下载:0

[VHDL编程fir

说明:利用系数奇对称的性,节约一半乘法器资源,实现平行FIR滤波器的功能。-The function of parallel FIR filter is realized by using oddly symmetric coefficients and saving half of the multiplier resources.
<lerning dog> 在 2024-10-10 上传 | 大小:4817920 | 下载:0

[VHDL编程Comparateur-4-bits

说明:4-bit comparator code VHDL
<asmae taz> 在 2024-10-10 上传 | 大小:8192 | 下载:0

[VHDL编程Multiplexeur-4

说明:4-bit multiplexer code VHDL
<asmae taz> 在 2024-10-10 上传 | 大小:8192 | 下载:0

[VHDL编程1bitadder

说明:1 bit adder code VHDL
<asmae taz> 在 2024-10-10 上传 | 大小:8192 | 下载:0

[VHDL编程class11_uart_tx

说明:verilog编写的串口发送程序,学习串口的话可以用作参考,已经实际验证过-Verilog prepared by the serial port to send procedures, learning serial port can be used as a reference, has actually verified
<> 在 2024-10-10 上传 | 大小:1231872 | 下载:0

[VHDL编程Multiplier

说明:复用全加器来实现乘法器, 通过从右到左互为输入输出,实现低位计算。最左向高位输出。具体要求请参见附带的PDF。-Multiplexing a multiplier to achieve full adder, input and output by each other right to left, the least significant bits is calculated. Most left output to high.
<Wind> 在 2024-10-10 上传 | 大小:378880 | 下载:0

[VHDL编程Bin2BCD

说明:FPGA代码,使用Verilog HDL语言实现4 bit二进制转换成BCD代码。原理是移位加三。-FPGA code, using Verilog HDL language is converted into a binary 4 bit BCD code. The principle is Shift-Add-3 .
<Wind> 在 2024-10-10 上传 | 大小:5763072 | 下载:0
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