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[VHDL编程filtra-lowpass

说明:this a lowpass filtre in VHDL code with a test_bench you will find some specifications of the FIR-this is a lowpass filtre in VHDL code with a test_bench you will find some specifications of the FIR
<mortadha> 在 2024-11-14 上传 | 大小:5kb | 下载:0

[VHDL编程ddr

说明:ddr2控制器设计,适用于xilinx fpga,内含IP软核 -ddr2 controller design for xilinx fpga, embedded IP soft core
<松鼠> 在 2024-11-14 上传 | 大小:4.71mb | 下载:0

[VHDL编程CrossClockDomain

说明:跨时钟域设计不错的设计,进过modelsim仿真通过。-Cross-clock domain design is good design been to modelsim simulation through.
<松鼠> 在 2024-11-14 上传 | 大小:1kb | 下载:0

[VHDL编程spi_rtl

说明:spi的rtl级代码设计,内含spi_slave和spi_master的行为模型-Rtl level behavioral model of spi code design, and includes spi_slave of spi_master
<松鼠> 在 2024-11-14 上传 | 大小:5kb | 下载:0

[VHDL编程sdr_ctrl_latest.tar

说明:SDRAM控制器设计源码,内含仿真代码,测试通过-SDRAM controller design source code, include simulation code, test by
<松鼠> 在 2024-11-14 上传 | 大小:2.15mb | 下载:0

[VHDL编程1

说明: 基于FPGA的花样流水灯,实现多种8个LED多种方式流动的 verilog程序。-FPGA-based pattern water lights, LED achieve a variety of eight various ways flow verilog program.
<陆彧> 在 2024-11-14 上传 | 大小:2kb | 下载:0

[VHDL编程PWM

说明:用按钮控制PWM占空比,两个按钮调大调小,每次按键改变占空比1 。-Use the button to control the PWM duty cycle, two button adjusted, each button changes the duty cycle 1 .
<刘豫> 在 2024-11-14 上传 | 大小:9kb | 下载:0

[VHDL编程xuanpin

说明:用两个按键分别控制占空比的频率和占空比 8中频率 和四种占空比可调 可自己叫消抖,上机可用-Two buttons control the duty cycle frequency and duty cycle 8 adjustable frequency and duty cycle of four kinds can call themselves debounced on board available
<辛书伟> 在 2024-11-14 上传 | 大小:1kb | 下载:0

[VHDL编程anjianled

说明:用按键控制流水灯一左移动亮起来,可自己修改成自己想要的型式-With a light water control buttons to move left lights up, you can make changes to the type you want to
<辛书伟> 在 2024-11-14 上传 | 大小:1kb | 下载:0

[VHDL编程Clock_div

说明:偶数分频及50占空比输出,很详细,适合初学者-Even frequency division and duty cycle of the output 50, in great detail, suitable for beginners
<辛书伟> 在 2024-11-14 上传 | 大小:1kb | 下载:0

[VHDL编程PWM_breath

说明:呼吸灯自动控制程序 ,暗到亮亮到暗 ,调整占空比-Breathing lights automatically control procedures very fun wow
<辛书伟> 在 2024-11-14 上传 | 大小:1kb | 下载:0

[VHDL编程fenpin

说明:基于50M分10K 1K 1000 100 10 1的分频,占空比 10/1-Based 50M min 10K 1K 1000 100 10 1 division, duty cycle 10/100
<辛书伟> 在 2024-11-14 上传 | 大小:1kb | 下载:0
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