[VHDL编程] Verilog-HDL-Coding

说明：Motorala推荐的Verilog代码规范。对于VerilogHDL语言编写很有借鉴意义。-Motorala recommended Verilog code specifications. VerilogHDL language is useful for reference.
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[VHDL编程] Tetris_final

说明：FPGA俄罗斯方块。 -采用VHDL编写，该游戏支持PS2键盘输入，VGA视频输出，游戏可以选择不同难度，同时可以记录显示游戏得分。-FPGA Tetris. - Use of VHDL, the game supports PS2 keyboard input, VGA video output, the game can choose different difficulty, while records show game sco
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[VHDL编程] verilog-experience-for-beginners

说明：VerilogHDL语言的设计经验，适合初学者入门学习，包含了Verilog编写时需要注意的很多方面，很有参考价值。-VerilogHDL language of design experience, suitable for beginners to learn, including the need to pay attention when writing Verilog many aspects of great referen
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[VHDL编程] 100-FPGA-question_Introduction

说明：FPGA经典100问之《入门与提高5问》。介绍了FPGA入门时的许多注意事项，对FPGA的快速入门很有帮助，初学者必备！-FPGA 100 and asked the classic " entry and improve 5 ask." It introduces many considerations when FPGA starter on quickstart helpful FPGA, beginner ne
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[VHDL编程] 100-FPGA-questions-Download

说明：FPGA经典100问之＜下载验证16问＞。介绍了FPGA在下载验证过程中的常见问题，对FPGA常见配置电路进行了讲解。-FPGA asked the classic 100 < Download verified 16 Q> . FAQ introduced FPGA verification process the download of FPGA configuration circuit common were expla
<> 在 2025-04-24 上传 | 大小：545kb | 下载：0

[VHDL编程] 32mto1m

说明：主要实现将32Mhz的时钟，通过一个触发信号将其分成1Mhz的互补信号，总共十个周期的，十个周期后输出为零-The main achievement of the clock 32Mhz by a trigger signal will be divided into complementary signals 1Mhz, for a total of ten cycles, after ten cycles output is zer
<张轩涛> 在 2025-04-24 上传 | 大小：160kb | 下载：0

[VHDL编程] FPGA

说明：包括密勒码编解码、循环码编解码、FSK和PSK调制解调-Including Miller encoding and decoding, encoding and decoding cycle, FSK and PSK modulation and demodulation
<李飞> 在 2025-04-24 上传 | 大小：249kb | 下载：0

[VHDL编程] 61EDA_C2701

说明：开发环境vhdl FPGA实现的NandFlash控制器（带ECC）文档+源代码-Vhdl FPGA development environment to achieve NandFlash controller (with ECC) document+ source code
<谢小虎> 在 2025-04-24 上传 | 大小：1.51mb | 下载：0

[VHDL编程] sport

说明：基于FPGA的数字秒表，通过按键开始计时，再次按下暂停，按下复位键清零-FPGA-based digital stopwatch, through the button to start timing, press pause again, press the reset button clears
<11> 在 2025-04-24 上传 | 大小：551kb | 下载：0

[VHDL编程] clkdiv

说明：对于fpga的时钟分频，编程方法，简单易懂，赠给各位学习fpga的同志们-For fpga clock frequency division, programming method, and easy to understand, to your learning fpga comrades
<fanbin> 在 2025-04-24 上传 | 大小：1kb | 下载：0

[VHDL编程] uart

说明：UART developement in VHDL
<mohamed bouasria> 在 2025-04-24 上传 | 大小：74kb | 下载：0

[VHDL编程] TLC

说明：Vhdl code for traffic light controller
<sanket> 在 2025-04-24 上传 | 大小：1kb | 下载：0