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[VHDL编程HAPF_SLAVE2

说明:高压链式SVG控制用FPGA的verilog程序,其中包括SPI,16路SCI同步通讯模块程序,保护自锁功能程序,基于滞环的无功功率检测和补偿策略;还包括FPGA和DSP之间通过总线方式进行数据的快速交互等;程序完整-SVG high voltage chain of verilog FPGA control procedures, including SPI, 16 road SCI synchronous communication
<> 在 2024-11-18 上传 | 大小:17kb | 下载:1

[VHDL编程iic

说明:i2c接口的功能实现代码,用VERILOG编写,并附有testbench.-i2c interface function implementation code, written in VERILOG, along with testbench
<jianglei> 在 2024-11-18 上传 | 大小:522kb | 下载:0

[VHDL编程uart

说明:串口的实现代码,用verilog编写的,并附有仿真文件。-Serial implementation code written using verilog, together with simulation files.
<jianglei> 在 2024-11-18 上传 | 大小:978kb | 下载:0

[VHDL编程sdram_mdl

说明:基于SDRAM的读写调试试验,使用verilog语言编写,经过调试。-SDRAM-based literacy commissioning tests, using verilog language, through debugging.
<jianglei> 在 2024-11-18 上传 | 大小:2.18mb | 下载:0

[VHDL编程fenpin

说明:该程序是对输入时钟进行分频,这里是可以改变分频倍数的,这个是一个八分频的程序-The program is the input clock frequency, here is changing the division multiples, this is one eighth the frequency of the program
<孙乐> 在 2024-11-18 上传 | 大小:253kb | 下载:1

[VHDL编程YCbCr_camera

说明:实现YCbCr转rgb和rgb转YCbCr-Image format conversion
<刘强> 在 2024-11-18 上传 | 大小:14.38mb | 下载:0

[VHDL编程image

说明:用来产生bayer彩色格式的图像测试程序,可生成彩色条纹,2tap输出-Bayer color format used to generate the image of a test program that can generate colored stripes, 2tap output
<孙敬辉> 在 2024-11-18 上传 | 大小:1kb | 下载:0

[VHDL编程ir

说明:这是一个红外遥控程序,可以遥控LED灯,数码管。语言verilog hdl-This is an infrared remote control program that can be remotely controlled LED lights, digital control. Language verilog hdl
<liweidi> 在 2024-11-18 上传 | 大小:1.57mb | 下载:0

[VHDL编程AD9280-

说明:进阶实验_15_AD[AD9280] :采集模拟输入,电压动态显示在数码管 - 副本-Advanced Experimental _15_AD [AD9280]: acquire analog input voltage dynamic display digital tube- copy
<liweidi> 在 2024-11-18 上传 | 大小:1.41mb | 下载:0

[VHDL编程video_center_scan_scaler_alpha_blend

说明:本工程实现两路视频信号阿尔法通道混合(alpha blend), 视频信号黑点中心 点扫描定位,期间用到视频帧缓存(fr a me cache)、视频信号缩放(scaler)等,且用到ram、DDR2等作为缓存,是很值得参考的视频图像处理工程。-scaler,alpha blend,ddr2 controller,center scan, fr a me cache, dpram, etc by verilog, includ
<冰凝> 在 2024-11-18 上传 | 大小:8.09mb | 下载:0

[VHDL编程pal_disp

说明:实现模拟PAL格式数据,并打包成BT656到监视器显示,过程中完成了PAL打包BT656,乒乓操作、监视器配置控制等-PAL to BT656 package, monitor control
<冰凝> 在 2024-11-18 上传 | 大小:8.64mb | 下载:0

[VHDL编程FFT-VHDL-source-code

说明:FFT的FPGA源码VHDL,代码说明在代码文件内有注释。-FPGA FFT VHDL source code
<冰凝> 在 2024-11-18 上传 | 大小:2kb | 下载:0
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