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文件名称:16_bits_CPU_verilog_code

  • 所属分类：
  • VHDL编程
  • 资源属性：
  • [WORD]
  • 上传时间：
  • 2012-11-26
  • 文件大小：
  • 860kb
  • 下载次数：
  • 0次
  • 提 供 者：
  • 王**
  • 相关连接：
  • 无
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修正介绍说明

介绍说明－－下载内容均来自于网络，请自行研究使用

利用Verilog设计的16位CPU的设计案例-the example of 16 bits CPU using verilog
相关搜索： verilog
16
bits

(系统自动生成,下载前可以参看下载内容)

下载文件列表

16位CPU的verilog代码\cpu\CPU.v

....................\...\decoder.v

....................\...\ram.v

....................\...\RISC_CPU设计练习.doc

....................\...\rom.v

....................\...\test.v

....................\...\test1.dat

....................\...\test1.pro

....................\...\test2.dat

....................\...\test2.pro

....................\...\test3.dat

....................\...\test3.pro

....................\...\test4.dat

....................\...\test4.pro

....................\...\test5.dat

....................\...\test5.PRO

....................\...\transcript

....................\...\vsim.wlf

....................\...\模拟结果.txt

....................\...\说明.txt

....................\cpu.rar

....................\cpu

16位CPU的verilog代码

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