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文件名称:zxcpu

  • 所属分类：
  • VHDL编程
  • 资源属性：
  • [Text]
  • 上传时间：
  • 2012-11-26
  • 文件大小：
  • 1.03mb
  • 下载次数：
  • 0次
  • 提 供 者：
  • zha****
  • 相关连接：
  • 无
  • 下载说明：
  • 别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容均来自于网络，请自行研究使用

用VHDL语言设计了一个含10条指令的RISC处理器。假定主存可以在一个始终周期内完成依次读写操作且和CPU同步，系统使用一个主存单元。处理器指令字长16位，包含8个通用寄存器，1个16位的指令寄存器和一个16位的程序记数器。处理器的地址总线宽度16位。数据总线宽度16位，取指和数据访问均在一跳蝻数据总线。处理器支持包含LDA，STA，MOV，MVI，ADD，SUB，AND，OR，JZ，JMP十条指令。其中仅有LDA和STA是访存指令。-VHDL language design with a RISC processor with 10 instruction. Assume that main memory can be completed in one cycle is always followed and the CPU read and write operations and the synchronization system uses a main memory unit. 16-bit instruction word processor, including 8 general purpose registers, a 16-bit instruction register and a 16-bit program counter. Processor' s address bus width 16 bits. 16-bit data bus width, fetch and data access are in the hop hoppers data bus. Processor support includes LDA, STA, MOV, MVI, ADD, SUB, AND, OR, JZ, JMP ten instructions. LDA and STA is the only one memory access instructions.
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bit
risc
cpu
16
bit
RISC
processor
Design

(系统自动生成,下载前可以参看下载内容)

下载文件列表

zxcpu\.untf

.....\automake.log

.....\back.ANT

.....\back.fdo

.....\back.tbw

.....\back.udo

.....\back.vhw

.....\backwr.cmd_log

.....\backwr.lso

.....\backwr.ngc

.....\backwr.ngr

.....\backwr.prj

.....\backwr.stx

.....\backwr.syr

.....\backwr.vhdl

.....\bitgen.ut

.....\clk.ANT

.....\clk.fdo

.....\clk.tbw

.....\clk.udo

.....\clk.vhw

.....\clock.cmd_log

.....\clock.lso

.....\clock.ngc

.....\clock.ngr

.....\clock.prj

.....\clock.stx

.....\clock.syr

.....\clock.vhdl

.....\coregen.log

.....\coregen.prj

.....\coregen_lock

.....\CPU

.....\cpu.bgn

.....\cpu.bit

.....\cpu.bld

.....\cpu.cmd_log

.....\cpu.dhp

.....\cpu.drc

.....\cpu.lso

.....\cpu.mrp

.....\cpu.nc1

.....\cpu.ncd

.....\cpu.ngc

.....\cpu.ngd

.....\cpu.ngm

.....\cpu.ngr

.....\cpu.npl

.....\cpu.pad

.....\cpu.pad_txt

.....\cpu.par

.....\cpu.pcf

.....\cpu.placed_ncd_tracker

.....\cpu.prj

.....\cpu.routed_ncd_tracker

.....\cpu.stx

.....\cpu.syr

.....\cpu.twr

.....\cpu.twx

.....\cpu.ucf

.....\cpu.ucf.untf

.....\cpu.ut

.....\cpu.vhdl

.....\cpu.xpi

.....\cpuall.vhdl

.....\CPUdata

.....\cpuw.ANT

.....\cpuw.fdo

.....\cpuw.tbw

.....\cpuw.udo

.....\cpuw.vhw

.....\cpu_last_par.ncd

.....\cpu_map.ncd

.....\cpu_map.ngm

.....\cpu_pad.csv

.....\cpu_pad.txt

.....\fet.ANT

.....\fet.fdo

.....\fet.tbw

.....\fet.udo

.....\fet.vhw

.....\fetch.cmd_log

.....\fetch.lso

.....\fetch.ngc

.....\fetch.ngr

.....\fetch.prj

.....\fetch.stx

.....\fetch.syr

.....\fetch.vhdl

.....\mem.ANT

.....\mem.fdo

.....\mem.tbw

.....\mem.udo

.....\mem.vhw

.....\memory.cmd_log

.....\memory.lso

.....\memory.ngc

.....\memory.ngr

.....\memory.prj

.....\memory.stx

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