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[VHDL编程] Top_MIL_1553B
说明:This the project, which implements MIL_1553 protocol.-This is the project, which implements MIL_1553 protocol.<Alex > 在 2025-01-19 上传 | 大小:3kb | 下载:0
[VHDL编程] Code-speed-adjustment-circuit
说明:基于同步的数字 复接系统, 即输入的数据码流速率相同。若各 支路 的数 据码 流速 率不 同, 则 不能 直接 进行 复接, 因为复接合成后的数字信 号流, 在 接收端是无法分接恢复成原来的信号的, 为此在复接 前要使各支路数码率同步, 我们可以在设计的同步数字复接系 统前方加一码速调整单元, 以调整各支路的速码率使其同步, 并在分接 后再经过码速调整恢复为原来的速率。 -Based on the synchronous digit<谢政龙> 在 2025-01-19 上传 | 大小:681kb | 下载:0
[VHDL编程] 5CSXFC6D6F31C8N_pin_location
说明:友晶科技公司开发板SOC-KIT的FPGA芯片5CSXFC6D6F31C8N的管脚分布,使用与此开发板的使用者-Pin Terasic company SOC-KIT development board FPGA chip 5CSXFC6D6F31C8N distribution, and use this development board users<Hunter> 在 2025-01-19 上传 | 大小:490kb | 下载:0
[VHDL编程] Borax_BA5_SoC_Kit_Rev2
说明:骏龙科技有限公司Borax开发板SoC_Kit的实例程序,适合此开发板的使用者-Cytech technology Borax development board SoC_Kit examples of procedures for the development board users<Hunter> 在 2025-01-19 上传 | 大小:1.76mb | 下载:0
[VHDL编程] ITU_656_Encoder
说明:ITU_656协议下的图像编程代码,适用于此协议下传输图像的开发者-The image programming code under the ITU_656 protocol, suitable for transmission of images to developers under this Agreement<Hunter> 在 2025-01-19 上传 | 大小:1kb | 下载:0
[VHDL编程] CLK_DIV_IP_packager
说明:Vivado IP packager的实例。Vivado版本2014.2,使用Verilog语言对一个分频程序打包。-Examples of Vivado IP packager. Vivado version 2014.2, using the Verilog language for a division of the program package.<LIU-Jianlinag> 在 2025-01-19 上传 | 大小:674kb | 下载:0