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[VHDL编程] ethernet__verilog
说明:fpga模拟以太网物理层的源代码,用verilog硬件描述语言开发。-FPGA simulation of the Ethernet physical layer of the source code, using Verilog hardware descr iption language development.<王贤> 在 2024-11-11 上传 | 大小:323kb | 下载:0
[VHDL编程] 8stepSymmetryCoefficientFilter
说明:8阶对称系数并行FIR滤波器(verilog)用作数字滤波,系数可调。根据实际截止频率决定。-8-order FIR filter symmetric coefficients parallel (verilog) used for digital filtering, adjustable coefficient. Decisions based on the actual cut-off frequency.<TGY> 在 2024-11-11 上传 | 大小:1kb | 下载:0
[VHDL编程] S6_VGA_change
说明:verilog源代码,quartusII工程。程序实现VGA时序。控制VGA显示器输出图形。在quartusII中客直接运行,-Verilog source code, quartusII works. Procedures to achieve VGA timing. VGA graphics display control output. QuartusII in the direct run-off,<李晨> 在 2024-11-11 上传 | 大小:2.45mb | 下载:0
[VHDL编程] Electronwatch
说明:This a vhdl programme for realise an electron watch by max-plus II. The function includes time showing and time setting. It may be extended to other functions like alarming clock and so forth.<施红希> 在 2024-11-11 上传 | 大小:1kb | 下载:0
[VHDL编程] SystemOfTaxiFeeBasedOnVerilogHDL
说明:摘 要:以上海地区的出租车计费器为例,利用Verilog HDL语言设计了出租车计费器,使其具有时间 显示、计费以及模拟出租车启动、停止、复位等功能,并设置了动态扫描电路显示车费和对应时间,显示 了硬件描述语言Verilog—HDL设计数字逻辑电路的优越性。源程序经MAX+PLUS Ⅱ软件调试、优 化,下载到EPF1OK10TC144—3芯片中,可应用于实际的出租车收费系统。 关键词:Verilog HDL;电子自动化设<杨轶帆> 在 2024-11-11 上传 | 大小:207kb | 下载:0
[VHDL编程] smj_etester
说明:脉宽测试仪FPGA芯片的VHDL核心程序-Pulse width Tester FPGA chip VHDL core procedures<孙明杰> 在 2024-11-11 上传 | 大小:1kb | 下载:0