[VHDL编程] temperature

说明：基于VHDL控制的DS18B20温度测量程序，精确到小数点后两位，在实验板上通过；-VHDL-based control procedures DS18B20 temperature measurement, accurate to two decimal places, the board adopted in the experiment
<liao> 在 2024-11-13 上传 | 大小：2kb | 下载：0

[VHDL编程] f_adder

说明：用VHDL语言采用串行方法实现用1位全加器实现4位全加器-Using VHDL language using the serial method of using a full adder realize four full adder
<chenli> 在 2024-11-13 上传 | 大小：191kb | 下载：0

[VHDL编程] 030501708

说明：用ＶＨＤＬ来模拟实现钟最终实现数字电子钟的设计，其中要用７段数码管-Use VHDL to simulate the final bell realize realize the design of digital electronic clock, which use 7 digital tube
<chenli> 在 2024-11-13 上传 | 大小：1.11mb | 下载：0

[VHDL编程] 1002016p_Sa_5

说明：用ＶＨＤＬ语言实现８位十进制计数器的设计，计数结果用实验板上8个数码管显示-VHDL language with eight decimal realize the design of counters, counting the results of experiments on-board with 8 digital tube display
<chenli> 在 2024-11-13 上传 | 大小：53kb | 下载：0

[VHDL编程] UART

说明：经典UART程序，通用异步收发器设计的vhdl语言-UART classical procedures, UART VHDL design language
<yu_leo> 在 2024-11-13 上传 | 大小：6kb | 下载：0

[VHDL编程] VHDLexample

说明：VHDL的例子，是我学VHDL以来收集的，那出来共享，想要的下哈-VHDL example is I have learned since the collection of VHDL, and that out of sharing, the next you want to Kazakhstan
<陆见风> 在 2024-11-13 上传 | 大小：32kb | 下载：0

[VHDL编程] DDS_all

说明：这个是相当不错的EDA编程，是电子设计大赛准备期间我引以为自豪的一个，能产生正弦，余弦，方波（可调占空比），三角波，锯齿波以及各种叠加波形，可以自行设置。-The EDA is a very good programming, is the Electronic Design Competition during the preparation I was proud to one capable of producing sine,
<谢飞> 在 2024-11-13 上传 | 大小：2.13mb | 下载：0

[VHDL编程] FPGA_VRILOG

说明：一套基于XILIX,SPATAN2,XC2S200 芯片实验板上的,10个典型VRILOGHDL的FPGA实验,有帮助,-Based on a set of XILIX, SPATAN2, XC2S200 chip experimental board, 10 of VRILOGHDL typical FPGA experiments help
<liao> 在 2024-11-13 上传 | 大小：11kb | 下载：0

[VHDL编程] tclk

说明：ALARM=1时蜂鸣器叫。 --第50秒时开始叫，连续叫10秒，前9秒为低音，最后1秒为高音。 --高音为500HZ，低音为250HZ。 --按住MS1（ML1灯灭）时自动加，按调分键MS2（ML2灯灭）分自动加。 --6个共阴LED数码管分别显示时/分/秒，6个LED数码管动态扫描显示。 -ALARM = 1 when called buzzer.- The first 50 seconds when called
<郝保峰> 在 2024-11-13 上传 | 大小：1kb | 下载：0

[VHDL编程] adder8b

说明：本程序是利用两个4位二进制并行加法器通过级联方式构成一个8位加法器。-This procedure is to use two four parallel binary adder cascade manner through an 8-bit adder.
<liushenshen> 在 2024-11-13 上传 | 大小：1kb | 下载：0

[VHDL编程] sdram_ctrl.tar

说明：同步动态RAM的控制电路VHDL源代码,在SOC开发中可以直接应用-Synchronous Dynamic RAM control circuit VHDL source code, in the SOC development can be applied directly
<26> 在 2024-11-13 上传 | 大小：88kb | 下载：0

[VHDL编程] video_compression_systems.tar

说明：视频压缩IPCORE,设计比较大,为硬件设计的工程师提高参考-Video Compression IPCORE, designed more for the hardware design engineers to improve reference
<26> 在 2024-11-13 上传 | 大小：182kb | 下载：0