[VHDL编程] freqdiv

说明：A frequenzzzy divider that divides the clock signal rate with a factor of 25.
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[VHDL编程] IO_controll

说明：this a controller, mainly for the nexys2 board based around the spartan 3E fpga from xilinx. controlls various outputs and inputs.-this is a controller, mainly for the nexys2 board based around the spartan 3E fpga from x
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[VHDL编程] stoppsignal

说明：A VHDL module that counts long pulses on the inport counting rising edges.
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[VHDL编程] bei

说明：应用VHDL语言写的倍频器，通过对高频信号的分频得到较低频率信号的倍频-Applications written in VHDL multiplier, high-frequency signals through low frequency signal divided by the frequency
<胡佳> 在 2025-01-16 上传 | 大小：1kb | 下载：0

[VHDL编程] clk_div

说明：deviseur de fréquence pour fpga
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[VHDL编程] counter

说明：counter design in vhdl
<rukan> 在 2025-01-16 上传 | 大小：1kb | 下载：0

[VHDL编程] HDB3

说明：HDB3编码 利用VDHL语言编写 实现数字基带传输HDB3编码-HDB3 code
<kid> 在 2025-01-16 上传 | 大小：1kb | 下载：0

[VHDL编程] PN7

说明：vhdl语言实现 pn码发生器 dpsk调制 以及扩频器-pn code generator vhdl language modulation and spread spectrum devices dpsk
<kid> 在 2025-01-16 上传 | 大小：1kb | 下载：0

[VHDL编程] code(opp)

说明：vhdl语言实现线性分组码的编码以及解码-vhdl language of linear block code encoding and decoding
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[VHDL编程] Cllk20Mto10

说明：分频器，将20Hz的时钟信号分频到10Hz-Divider, the clock signal frequency 20Hz to 10Hz
<凤琰> 在 2025-01-16 上传 | 大小：1kb | 下载：0

[VHDL编程] 2s_Compl_2_4.0.vhd

说明：complement calculator
<Ahmed Alkaff> 在 2025-01-16 上传 | 大小：1kb | 下载：0

[VHDL编程] 4_Bit_CLA_4.0.vhd

说明：4-Bit Carry Look Ahead adder
<Ahmed Alkaff> 在 2025-01-16 上传 | 大小：1kb | 下载：0