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[VHDL编程Cymometer_of_four_decimal

说明:四位十进制数字频率计: 测量范围:1Hz~10kHz; 显示时间不少于1S; 具有记忆显示的功能,即在测量过程中 刷新数据,等结束后才显示测量结果,给出待测信号的频率值,并保存到下一次测量结束。-Four decimal digital frequency meter: measuring range: 1Hz ~ 10kHz show that no less than 1S with memory
<> 在 2025-01-24 上传 | 大小:3kb | 下载:0

[VHDL编程multiplier_8_bit

说明:This is 8bit multiplier VHDL code. It s consist of full adder, ripple carry adder(4bit, 8bit) multiplier 8bit, and test bench file. This is a unsigned type.-This is 8bit multiplier VHDL code. It s consist of full adder,
<KC.Park> 在 2025-01-24 上传 | 大小:3kb | 下载:0

[VHDL编程kp_uart

说明:This UART and LCD interface C code Tested on Sparton 3 xilinx FPGA.-This is UART and LCD interface C code Tested on Sparton 3 xilinx FPGA.
<bhagwan> 在 2025-01-24 上传 | 大小:3kb | 下载:0

[VHDL编程Rotorsystemcriticalspeedbeforethethird-ordermethod

说明:汽轮机转子系统前三阶临界转速的传递矩阵法-Turbine rotor system critical speed before the third-order transfer matrix method
<韩箫> 在 2025-01-24 上传 | 大小:3kb | 下载:0

[VHDL编程vhdl

说明:数码管现实bcd码的解码过程,0000-1001用数码管现实译码结果-Bcd nixie tube reality code
<taoli> 在 2025-01-24 上传 | 大小:3kb | 下载:0

[VHDL编程LCD

说明:用VHDL实现LCD的驱动电路的设计的源码-VHDL to achieve with the design of LCD source drivers, who are interested can look at the
<纳什> 在 2025-01-24 上传 | 大小:3kb | 下载:0

[VHDL编程verilog

说明:可以产生任意分频,任意占空比的程序,适合初学者-cis_system10 arbitrary frequency, arbitrary duty cycle
<孙明> 在 2025-01-24 上传 | 大小:3kb | 下载:0

[VHDL编程des

说明:this is des code of vhdl version.
<bluedkdk> 在 2025-01-24 上传 | 大小:3kb | 下载:0

[VHDL编程fifo.vhd

说明:This a FIFO in VHDL Code-This is a FIFO in VHDL Code
<lagartojj> 在 2025-01-24 上传 | 大小:3kb | 下载:0

[VHDL编程2fsk

说明:基于CPLD的数字通信系统2fsk 用VHDL形成2FSK信号-CPLD-based digital communications system 2fsk signal 2FSK formed with VHDL
<石一鸣> 在 2025-01-24 上传 | 大小:3kb | 下载:0

[VHDL编程2fsk-2psk

说明:基于CPLD的数字通信系统 2fsk-2psk 用VHDL产生 2fsk-2psk信号-CPLD-based digital communications system 2fsk-2psk generated by VHDL signals 2fsk-2psk
<石一鸣> 在 2025-01-24 上传 | 大小:3kb | 下载:0

[VHDL编程2mxulie

说明:基于CPLD的数字通信系统 2m序列 用VHDL产生 2m序列信号-CPLD-based digital communications systems using VHDL generate 2m sequence signal sequence 2m
<石一鸣> 在 2025-01-24 上传 | 大小:3kb | 下载:0
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