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[VHDL编程fir_Verilog

说明:用Verilog编写的fir滤波器程序!-Verilog prepared using the procedure fir filter!
<yuming > 在 2025-02-08 上传 | 大小:5kb | 下载:0

[VHDL编程USB

说明:USB源代码,基于VHDL语言编写,在QuartusII上面已验证其功能-USB source code, based on the VHDL language, verified in QuartusII above its function
<> 在 2025-02-08 上传 | 大小:5kb | 下载:0

[VHDL编程cyclone_devkit

说明:一个简单的clylon芯片的VHDL描述,希望对大家有点帮助-Clylon a simple chip VHDL descr iption, I hope all of you a little help
<肖冠兰> 在 2025-02-08 上传 | 大小:5kb | 下载:0

[VHDL编程signal

说明:用VHDL语言写的信号发生器,很不错的应用-VHDL language used to write the signal generator, a very good application
<th> 在 2025-02-08 上传 | 大小:5kb | 下载:0

[VHDL编程45370466

说明:基于vhdl语言描述的dpll,以及图片-Based on the VHDL language is described dpll, as well as the picture
<wb> 在 2025-02-08 上传 | 大小:5kb | 下载:0

[VHDL编程bujindianji

说明:vhdl代码!步进电机定位控制系统VHDL程序与仿真!初学者可以参考参考-VHDL code! Stepper motor positioning control system and simulation of VHDL procedures! Beginners can refer to reference
<daxiadian2> 在 2025-02-08 上传 | 大小:5kb | 下载:0

[VHDL编程KEYBOARD

说明:vhdl语言编写的电子密码锁的键盘程序,本源码复制在word中,请黏贴到MAXPLUS等相应软件下运行-VHDL language electronic locks the keyboard program, the source copy of the word, please stick to the appropriate software, such as MAXPLUS run
<网天才> 在 2025-02-08 上传 | 大小:5kb | 下载:0

[VHDL编程ASYNCFIFOXPXMOD

说明:任意时钟配比的异步fifo.含有synplify ip库中的双端口ram。用于处理多时钟域问题。-Arbitrary ratio of asynchronous clock fifo. Containing synplify ip library of dual-port ram. Used to deal with the issue of multi-clock domain.
<xupeixin> 在 2025-02-08 上传 | 大小:5kb | 下载:0

[VHDL编程alaw

说明:使用VHDL实现通信脉冲编码调制(PCM)中的a律转换,并实现串并、并串转换。-Use VHDL to achieve communication pulse code modulation (PCM) of a law conversion, and to achieve and string, and string conversion.
<wl> 在 2025-02-08 上传 | 大小:5kb | 下载:0

[VHDL编程ulaw

说明:使用VHDL语言,实现通信脉冲编码调制(PCM)的u律压缩。-Using VHDL language, the realization of communication pulse code modulation (PCM) of u law compression.
<wl> 在 2025-02-08 上传 | 大小:5kb | 下载:0

[VHDL编程multiply2

说明:18bit的booth乘法器 采用booth2编码 Wallace压缩树 以及超前进位结合进位选择的36bit高性能加法器-18bit multipliers used booth2 the booth encoding and Wallace tree compression-ahead into the location choice of high-performance 36bit adder
<alex> 在 2025-02-08 上传 | 大小:5kb | 下载:0

[VHDL编程vhdl_tabletennis

说明:
<buqianni> 在 2025-02-08 上传 | 大小:5kb | 下载:0
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