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[VHDL编程ycbcr2rgb

说明:color space transformation with input coefficiences
<Long> 在 2025-01-20 上传 | 大小:1kb | 下载:0

[VHDL编程mux

说明:对20MHZ时钟进行分频。之后用分频后的频率作为时钟信号同步后级的模16计数器。4位计数器输出信号可以用来控制MUX进行数据通道的定时采集。-To 32 magnitude optional 20 MHZ clock frequency division.After using crossover frequency as the clock signal synchronization after level 16 counter m
<曾玉> 在 2025-01-20 上传 | 大小:1kb | 下载:0

[VHDL编程boxingfashengqi

说明:能产生方波和三角波的信号发生器,以时钟信号为基准,输出时可以选择一种信号输出。-Can produce a square wave and triangular wave signal generator to the reference clock signal, a signal output can be selected output.
<lyp> 在 2025-01-20 上传 | 大小:1kb | 下载:0

[VHDL编程vga

说明:vga实现汉字显示,只有。v和ucf文件 基于sprtan3e板-vga word print
<王晓军> 在 2025-01-20 上传 | 大小:1kb | 下载:0

[VHDL编程cic5r61

说明:实现CIC5级滤波器功能。可以达到提亲一位或者延迟一采样的功能-Achieve CIC5 stage filter function.
<lihe> 在 2025-01-20 上传 | 大小:1kb | 下载:0

[VHDL编程FPGA_CIC

说明:用Count计数法实现5级CIC滤波器,能够提前或者延迟一个周期采样。能综合-Implementation level 5 CIC filter with Count counting method, one can advance or delay the sampling period.
<lihe> 在 2025-01-20 上传 | 大小:1kb | 下载:0

[VHDL编程DA

说明:verilog 串行AD转换 TLC549AD采样程序-verilog serial AD converter TLC549AD sampling procedures
<祝春晖> 在 2025-01-20 上传 | 大小:1kb | 下载:0

[VHDL编程bt656_decode

说明:bt656 标准的解码 verilog 语言-bt656 decode
<xujianfeng> 在 2025-01-20 上传 | 大小:1kb | 下载:0

[VHDL编程rxpart

说明:uart异步串口收模块,将串口数据进行组合变成8位的字节。波特率可自行调节-uart receive asynchronous serial module, serial data will be combined to become 8 bytes. The baud rate of self-regulation
<郭先生> 在 2025-01-20 上传 | 大小:1kb | 下载:0

[VHDL编程2_led

说明:基于nios ide编程并下载至FPGA中的led灯闪亮程序-Based nios ide programmed and downloaded to the FPGA program led lights flashing
<yanhuazhen> 在 2025-01-20 上传 | 大小:1kb | 下载:0

[VHDL编程AD_4-

说明:ADC,芯片AD7812的转换代码,可实现AD转化,AD芯片用的是AD7812,实现16位数模转化-Verilog HDL code, the AD conversion can be achieved. AD-chip using a AD7812
<管鑫> 在 2025-01-20 上传 | 大小:1kb | 下载:0

[VHDL编程osh

说明:Verilog开发脚本文件,Cyclone四代引脚分配源文件-Verilog development scr ipt file, cyclone pinout four generation file
<管鑫> 在 2025-01-20 上传 | 大小:1kb | 下载:0
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