资源列表
[VHDL编程] eetop.cn_dds
说明:基于verilog的DDS设计,内附代码,仿真环境等说明-the DDS design based on verilog<王亮> 在 2024-10-14 上传 | 大小:3165184 | 下载:0
[VHDL编程] FPGA_verilog_uart-
说明:基于 FPGA器件设计实现UART的波特率产生器、UART发送器和接收器及其整合电路,,利用Veriolog-HDL语言对这三个功能模块进行描述并加以整合,通过ModelSim仿真,用串口调试程序进行验证,最终实现一个通用异步收发器的设计。-UART baudrate generator, transmitter and receiver and its integrated circuit are implemented by FPG<孔春伟> 在 2024-10-14 上传 | 大小:3165184 | 下载:1
[VHDL编程] Vivado--设计流程指导手册-(含安装流程与仿真)
说明:vivado设计流程指导文件,里面包含有软件安装流程以及仿真流程(Vivado design flow guidance document, which contains software installation process and simulation process)<bikey > 在 2024-10-14 上传 | 大小:3169280 | 下载:0
[VHDL编程] pulse
说明:这是一个方波程序,在quartus平台编写,可以通过设置参数生成方波信号。(This is a square wave program, written in the quartus platform, you can generate square wave signals by setting parameters.)<wangshuo9242 > 在 2024-10-14 上传 | 大小:3165184 | 下载:0