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[VHDL编程traffic1

说明:只有代码/* 信号定义与说明: CLK: 为同步时钟; EN: 使能信号,为1 的话,则控制器开始工作; LAMPA: 控制A 方向四盏灯的亮灭;其中,LAMPA0~LAMPA3,分别控制A 方向的 左拐灯、绿灯、黄灯和红灯; LAMPB: 控制B 方向四盏灯的亮灭;其中,LAMPB0 ~ LAMPB3,分别控制B 方向的 左拐灯、绿灯、黄灯和红灯; ACOUNT: 用于A 方向灯的时间显示,8 位,可驱动两
<syh> 在 2025-01-10 上传 | 大小:1kb | 下载:0

[VHDL编程keyscan

说明:2×8 键盘扫描编程--- VHDL语言-2×8 keyboard scan---VHDL language
<rjy> 在 2025-01-10 上传 | 大小:1kb | 下载:0

[VHDL编程YCbCr_RGB_10bit

说明:YCbCr 转 RGB模块,以应用于项目中。 该模块可将10bitYCbCr分量视频转换为12bitRGB视频,需消耗乘法器。-YCbCr turn RGB module, to apply to the project. The module can be 10bitYCbCr component video converted to 12bitRGB video, need to consume multiplier.
<张曦> 在 2025-01-10 上传 | 大小:1kb | 下载:0

[VHDL编程FINALWORK

说明:简易信号发生器 可产生正弦波、方波、三角波、锯齿波 周期可调 verilog-Simple signal generator can produce sine, square, triangle wave, sawtooth-cycle adjustable verilog
<tank tan> 在 2025-01-10 上传 | 大小:1kb | 下载:0

[VHDL编程frehp

说明:基于频率抽样方法实现Ⅰ型FIR数字高通滤波器-Based on the frequency sampling method to achieve type Ⅰ FIR digital high-pass filter
<liguohong> 在 2025-01-10 上传 | 大小:1kb | 下载:0

[VHDL编程ciper

说明:VHDL语言,基于Xilinx平台的电子密码锁。-VHDL language, based on the Xilinx platform of electronic locks.
<yangyi> 在 2025-01-10 上传 | 大小:1kb | 下载:0

[VHDL编程8QAM

说明:8 array QAM design using HDL
<jai> 在 2025-01-10 上传 | 大小:1kb | 下载:0

[VHDL编程pingpang

说明:基于FPGA的乒乓球游戏。。VHDL语言-FPGA-based table tennis game. . VHDL language. .
<syf> 在 2025-01-10 上传 | 大小:1kb | 下载:0

[VHDL编程dmfilter

说明:gps接收机伪码捕获时采用的匹配滤波器,能完成接收码的捕获。-gps receiver pseudo-code used to capture the matched filter, receiving yards to complete the capture.
<易凯> 在 2025-01-10 上传 | 大小:1kb | 下载:0

[VHDL编程dual_RAM

说明:vhdl语言编写的双口ram及testbench,模块可以在modelsim里进行时序和功能仿真。-vhdl language of the dual-port ram, and testbench, modules, conducted in the modelsim timing and functional simulation.
<易凯> 在 2025-01-10 上传 | 大小:1kb | 下载:0

[VHDL编程uart_rx

说明:Universal Asyncronos Received Transmitter
<preseo> 在 2025-01-10 上传 | 大小:1kb | 下载:0

[VHDL编程mod_m_counter

说明:Frequence Divisor for the Universal Received Transmitter
<preseo> 在 2025-01-10 上传 | 大小:1kb | 下载:0
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