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[VHDL编程SRDFF

说明:Zip file contains the shiftregister code using verilog HDL
<Jaganathan> 在 2025-01-09 上传 | 大小:1kb | 下载:0

[VHDL编程QEP_FOR_ENCODER

说明:ALTERA MAX Ⅱ EPM570上QEP的源码,已经通过测试。-ALTERA MAX Ⅱ EPM570 source code on the QEP has been tested.
<龙也> 在 2025-01-09 上传 | 大小:1kb | 下载:0

[VHDL编程ddpi_rx

说明:描写处理器与FPGA之间的接口程序,使用verilog语言编写-Describes the interface between the processor and the FPGA program, using the verilog language
<yaop> 在 2025-01-09 上传 | 大小:1kb | 下载:0

[VHDL编程clocktest.vhdl

说明:时钟测试,vhdl,四位状态灯的转换,有复位信号-Clock test, vhdl, four status lights conversion, there are reset signal
<李维> 在 2025-01-09 上传 | 大小:1kb | 下载:0

[VHDL编程out_50hz

说明:输入频率,用CPLD驱动8位DA,产生正玄信号-用CPLD驱动8位DA,产生正玄信号
<鲁先生> 在 2025-01-09 上传 | 大小:1kb | 下载:0

[VHDL编程StateMachine-based

说明:FPGA上的利用状态机实现的分频的verilog程序-verilog source code StateMachine-based for FPGA
<pei fu-jun> 在 2025-01-09 上传 | 大小:1kb | 下载:0

[VHDL编程vhdlcode

说明:VHDL code in ISE (for collecting the ADC samples from kit and for viewing final output)
<venkata> 在 2025-01-09 上传 | 大小:1kb | 下载:0

[VHDL编程ami_encoder

说明:This a vhdl code for Alternate Mark inversion line coding, it is used for baseband transmission.-This is a vhdl code for Alternate Mark inversion line coding, it is used for baseband transmission.
<snakebytes01> 在 2025-01-09 上传 | 大小:1kb | 下载:0

[VHDL编程testadder

说明:VHDL语言编写的加法器与测试代码,测试可用-Adder VHDL language and test code, the test can be used
<hank> 在 2025-01-09 上传 | 大小:1kb | 下载:0

[VHDL编程FastCplxMuply

说明:This zip folder contains the verilog code for fast complex multiplication source code and its test bench
<Jaganathan> 在 2025-01-09 上传 | 大小:1kb | 下载:0

[VHDL编程fenpinqi

说明:经典的分频器程序设计,分辨对偶数倍分频和奇数倍分频进行了EDA的程序编写,通过这两个程序,可写出所有的分频器设计-Classic divider programming, identify multiple points on the dual-frequency and odd multiples of the sub-frequency EDA programming carried out by these two program
<笑笑> 在 2025-01-09 上传 | 大小:1kb | 下载:0

[VHDL编程PCK_CRC16_D8

说明:VERILOG的CRC代码,节约资源,高效.欢迎提意见-good verilog for crc,is good for fpga.welcome to down
<sxh> 在 2025-01-09 上传 | 大小:1kb | 下载:0
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