[VHDL编程] DHT11

说明：verilog实现DHT11温湿度的读取(The realization of DHT11 temperature and humidity reading by Verilog)
<iseaad> 在 2024-12-23 上传 | 大小：920kb | 下载：0

[VHDL编程] Clock

说明：本设计实现了一种基于FPGA的数字时钟设计，应用Verilog硬件描述语言进行数字电路设计，采用自顶向下的方法将电路系统逐层分解细化，设计数字时钟总体结构、各模块及相应具体电路。在Quartus II 9.0工具软件环境下编译、仿真。最后下载到FPGA实验平台进行测试。本数字时钟具有显示时间、通过按键校准时间、整点报时等功能。(This design realizes a digital clock design based on FP
<威威谈谈> 在 2024-12-23 上传 | 大小：3.66mb | 下载：0

[VHDL编程] pipo_piso Verilog

说明：Verilog codes for pipo_piso
<gsrwork2017@gmail.com> 在 2022-02-17 上传 | 大小：828byte | 下载：0

[VHDL编程] Counter_verilog

说明：Verilog codes for different counters
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[VHDL编程] FSM_design using Verilog

说明：FSM verilog (Mealy and moore)
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[VHDL编程] Memory Verilog

说明：ROM,RAM (dual port)- Verilog
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[VHDL编程] CSD Multiplier_Verilog

说明：CSD Multiplier Verilog
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[VHDL编程] Low Power Multiplier Verilog

说明：Low Power Multiplier Verilog
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[VHDL编程] VHDL codes for Combinational Designs

说明：VHDL codes for Combinational Designs
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[VHDL编程] VHDL codes for Sequential Designs

说明：VHDL codes for Sequential Designs
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[VHDL编程] Image Steganography_VHDL

说明：Complete VHDL codes for Image Steganography project
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[VHDL编程] NoC Verilog Codes

说明：Network on Chip design using XY routing algorithm with FPGA implementation (Verilog)
<gsrwork2017@gmail.com> 在 2022-02-17 上传 | 大小：7.59kb | 下载：0