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[VHDL编程T_0D

说明:带同步清0、同步置1的D触发器模块。希望能够帮到大家。(D trigger module with synchronous clear 0 and synchronous setting 1. I hope I can help you.)
<紫芩 > 在 2024-11-11 上传 | 大小:2.8mb | 下载:0

[VHDL编程Y_0D

说明:带同步置1、异步清0的D触发器。详细的讲解,易懂。(D flip-flop with synchronous 1 and asynchronous clear 0. Detailed explanation, easy to understand.)
<紫芩 > 在 2024-11-11 上传 | 大小:2.82mb | 下载:0

[VHDL编程m_manche

说明:有关于M序列的曼彻斯特编码,亲自验证有效。(The Manchester code of the M sequence is personally validated.)
<紫芩 > 在 2024-11-11 上传 | 大小:2.96mb | 下载:0

[VHDL编程diver

说明:根据芯片的始终频率进行分频,可调节占空比。容易实现。(The frequency division is carried out according to the chip frequency at all times, and the duty cycle is adjusted. Easy to implement.)
<紫芩 > 在 2024-11-11 上传 | 大小:2.93mb | 下载:0

[VHDL编程DDS

说明:基于FPGA的DDS正弦信号设计,文件中有源代码(Design of DDS based on FPGA)
<hdu > 在 2024-11-11 上传 | 大小:50kb | 下载:0

[VHDL编程nbwpm

说明:Data packet transfer source program, Chaos indicator for Lyapunov index calculation, Really is a good program.
<gingkangbou > 在 2024-11-11 上传 | 大小:7kb | 下载:0

[VHDL编程数字信号处理的FPGA实现-第三版-verilog源程序

说明:数字信号处理的FPGA实现, 包括了FPGA基础知识,浮点运算,信号处理的FIR FFT等,附录包含源代码(Digital signal processing FPGA implementation, including the basic knowledge of FPGA, floating point operations, signal processing FIR, FFT, etc., the appendix contai
<btty > 在 2024-11-11 上传 | 大小:4.36mb | 下载:0

[VHDL编程i2c_latest.tar

说明:基于verilog的I2C接口协议代码,支持EEPROM(Verilog based I2C interface protocol code, support EEPROM)
<老杜123 > 在 2024-11-11 上传 | 大小:1.41mb | 下载:0

[VHDL编程SEQ_DETECTOR

说明:这是一个四位串行数据检测器,一共有三种模式可以选择:递增(检测连续四位递增序列),递减(检测连续四位递减序列)和不变(检测连续四位不变序列)。整个设计采用同步时钟,异步复位,用米利状态机,并配置好了仿真环境和仿真文件。(This is a four bit sequence detector, including three modes that can be selected: increment mode (detecting fo
<LLawliet > 在 2024-11-11 上传 | 大小:1.77mb | 下载:0

[VHDL编程FMT

说明:基于vhdl设计的数字频率计,后面还加了个与fpga通信的模块(Digital frequency meter based on VHDL design, and later added a module to communicate with FPGA)
<羲曜 > 在 2024-11-11 上传 | 大小:13.11mb | 下载:0

[VHDL编程he

说明:利用VHDL实现判向计数器,并且在数码管上实现显示。可以在XILINX开发板上实现对应功能,仿真也能实现。(The use of VHDL realize the counter counter, and in the digital tube to achieve display. The corresponding function can be implemented on the XILINX development board
<勿要归晚 > 在 2024-11-11 上传 | 大小:730kb | 下载:0

[VHDL编程TutorialSpartan3EBasys

说明:it is the file which is named as starting KIT for Spartan 3E
<Saad_01 > 在 2024-11-11 上传 | 大小:457kb | 下载:0
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