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[VHDL编程] nios_16QAM_modu
说明:在alter公司的fpga上实现了一个最小niosII软核系统,可以作为简单开发的基础工程-A minimum of niosII soft core system is implemented in alter s FPGA, can be used as the basis of simple project development<zhubin> 在 2024-11-20 上传 | 大小:13.08mb | 下载:0
[VHDL编程] Antenova-(Legacy)
说明:Altium DEsigner Antenova libraries<Yandoniaina> 在 2024-11-20 上传 | 大小:9kb | 下载:0
[VHDL编程] led_24_terminal
说明:这是一段用VHDL语言写的24进制计数器,用数码管显示,我用了例化语句,分为24进制计数器模块,十位译码,个位译码,用cycloneII ep2系列实验板验证,能计数0~23。此程序还可以修改为100以内任何进制计数器。-This is a written in VHDL language 24 a binary counter, using digital tube display, I used the instantiated s<高安> 在 2024-11-20 上传 | 大小:345kb | 下载:0
[VHDL编程] IRIGDECODE
说明:IRIG-b 解码模块 采用VHDL编写,简单实用,已实测验证-IRIG-B DECODE VHDL<hw> 在 2024-11-20 上传 | 大小:2kb | 下载:0
[VHDL编程] Phase-Locked-Loop
说明:PLL CODE IN VERILOG DESIGN<GOPALAKRISHNAN E> 在 2024-11-20 上传 | 大小:391kb | 下载:0
[VHDL编程] 11.ppt
说明:THIS USEFULL FOR VLSI-THIS IS USEFULL FOR VLSI<GOPALAKRISHNAN E> 在 2024-11-20 上传 | 大小:962kb | 下载:0
[VHDL编程] first
说明:this is useful vlsi ppt explains<GOPALAKRISHNAN E> 在 2024-11-20 上传 | 大小:46kb | 下载:0