[VHDL编程] VGA

说明：vga显示硬件模块verilog语言编写，实现了一个动画显示，适合于初学者学习。-vga display hardware module verilog language to achieve an animated display, suitable for beginners to learn.
<张龙> 在 2025-04-06 上传 | 大小：1kb | 下载：0

[VHDL编程] huffman

说明：用verilog硬件语言实现了动态huffman编码，能够压缩字符串文件，展示了硬件的压缩率-Using verilog hardware descr iption language to achieve a dynamic huffman coding to compress the string file, showing the hardware compression rate
<张龙> 在 2025-04-06 上传 | 大小：3kb | 下载：0

[VHDL编程] IO-timing-constrain-in-fpga

说明：对FPGA的IO口的时序分析小结，能够详细理解其约束时序规则-FPGA timing analysis summary of IO port, capable of a detailed understanding of its timing constraint rules
<张龙> 在 2025-04-06 上传 | 大小：185kb | 下载：0

[VHDL编程] IIC

说明：硬件语言verilog实现IIC控制器，严格按照IIC协议编写硬件控制器行为及代码-Hardware language verilog realize IIC controllers, written in strict accordance with IIC protocol hardware controller behavior and codeHardware language verilog realize IIC contr
<张龙> 在 2025-04-06 上传 | 大小：2kb | 下载：0

[VHDL编程] MVLSI_CBP_16.-FPGA-based-for-Implementation-of-Mu

说明：Paper on FPGA-based-for-Implementation-of-Multi-Serials-to-Ethernet-Gateway
<PADDU> 在 2025-04-06 上传 | 大小：353kb | 下载：0

[VHDL编程] divby4.5.v

说明：This Divider by 4.5.-This is Divider by 4.5.
<Gourav Agarwal> 在 2025-04-06 上传 | 大小：1kb | 下载：0

[VHDL编程] lfsrupdwn.v

说明：This left shift register.-This is left shift register.
<Gourav Agarwal> 在 2025-04-06 上传 | 大小：1kb | 下载：0

[VHDL编程] divby3.v

说明：This Divider by 3.-This is Divider by 3.
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[VHDL编程] jkff_behav.v

说明：This is JK-FF in Behavioural Style.
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[VHDL编程] UartLoop

说明：xilinx FPGA XC6LX9 串口通信程序 返回发送内容-xilinx FPGA XC6LX9 serial communication program returns to send content
<书才> 在 2025-04-06 上传 | 大小：237kb | 下载：0

[VHDL编程] FX2LP-FPGA

说明：xilinx FPGA XC6LX9 与CY7C68013通信程序-xilinx FPGA XC6LX9 and communication program CY7C68013
<书才> 在 2025-04-06 上传 | 大小：587kb | 下载：0

[VHDL编程] fir128

说明：Discrete-Time FIR Filter, Filter length - 128, Number of Multipliers - 8, Number of States - 8.
<siv> 在 2025-04-06 上传 | 大小：3kb | 下载：0