[VHDL编程] Locking_device

说明：EDA课程设计，基于DE2板的八位十进制锁码器，vhdl源程序！-EDA curriculum design, based on the DE2 board to eight decimal lock code reader, vhdl source code!
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[VHDL编程] 1820

说明：verilog下18b20测温并显示到数码管上-verilog and display to the next 18b20 temperature on the digital control
<刘欣> 在 2025-03-21 上传 | 大小：6kb | 下载：0

[VHDL编程] vga

说明：verilog通过VGA显示一个汉字，800X600@72Hz-verilog character through a VGA display, 800X600 @ 72Hz
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[VHDL编程] res

说明：verilog下fpga4路抢答器，有数码管显示和蜂鸣-verilog next fpga4 Road Responder, a digital display and buzzer
<刘欣> 在 2025-03-21 上传 | 大小：5kb | 下载：0

[VHDL编程] timer

说明：verilog秒表fpga 4位数码管显示-verilog digital display stopwatch 4
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[VHDL编程] r232

说明：verilog下fpga串口，波特率115200，与PC通信-Under verilog fpga serial port, baud rate 115200, and PC communication
<刘欣> 在 2025-03-21 上传 | 大小：7kb | 下载：0

[VHDL编程] Four-binary-adder

说明：程序1：4位二进制加法计数器（EDA实验中用到的)-Four binary adder
<denwei0011> 在 2025-03-21 上传 | 大小：1kb | 下载：0

[VHDL编程] 1212

说明：由八位加法器构成的以时序逻辑方式设计的八位乘法器-Adder composed of eight logical way to sequence the eight multiplier design
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[VHDL编程] VHDL-language

说明：用VHDL语言完成4位锁存器、测频控制器的设计-VHDL language to complete 4-bit latch, the measured frequency controller design
<denwei0011> 在 2025-03-21 上传 | 大小：1kb | 下载：0

[VHDL编程] Analog-to-digital-converter

说明：模数转化器，64位双精度的模拟输入值，16位数字输出-Analog to digital converter, 64-bit double-precision analog inputs, 16 digital outputs
<chenxuying> 在 2025-03-21 上传 | 大小：1kb | 下载：0

[VHDL编程] duble-process-lock

说明：编写由两个主控进程构成的与上述功能相同的符号化Moore型有限状态机-The process of writing composed by two main control functions with the same symbol of Moore-type finite state machine
<denwei0011> 在 2025-03-21 上传 | 大小：1kb | 下载：0

[VHDL编程] State-machine-programming

说明：状态机编程 实验内容 1. Gray 编码和One-hot 编码两种状态机； 2. 触发器部分和组合逻辑部分结合与分开两种状态机。 -State machine programming experiment content 1. Gray coding and encoding two One-hot state machine 2 trigger part and the combinational logi
<张云> 在 2025-03-21 上传 | 大小：170kb | 下载：0