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文件名称:syn-fifo-verilog

  • 所属分类：
  • VHDL编程
  • 资源属性：
  • [WORD]
  • 上传时间：
  • 2012-11-26
  • 文件大小：
  • 98kb
  • 下载次数：
  • 1次
  • 提 供 者：
  • runx*****
  • 相关连接：
  • 无
  • 下载说明：
  • 别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容均来自于网络，请自行研究使用

用verilog语言写的同步FIFO设计源代码。-The source codes for syn-fifo using verilog language.
相关搜索： fifo
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fifo
syn_fifo
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core
syn
fifo
fifo
FIFO
syn

(系统自动生成,下载前可以参看下载内容)

下载文件列表

fifo_syn

........\fifo_syn_flag.v

........\fifo_syn_ram.v

........\fifo_syn_rdaddr_gen.v

........\fifo_syn_top.v

........\fifo_syn_wraddr_gen.v

........\fifo_top_tb.v

........\同步FIFO设计.doc

........\nLint.rc

........\nLint.ds

........\.fifo_top_tb.v.swp

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