文件名称:PIC-Code

  • 所属分类:
  • VHDL编程
  • 资源属性:
  • [ASM] [源码]
  • 上传时间:
  • 2012-11-26
  • 文件大小:
  • 1.89mb
  • 下载次数:
  • 0次
  • 提 供 者:
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介绍说明--下载内容均来自于网络,请自行研究使用

the verilog code used to design a PIC uC
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verilog
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pic
veril

(系统自动生成,下载前可以参看下载内容)

下载文件列表

proiectmada

...........\modif

...........\.....\ADDRMUX.v

...........\.....\ALU.v

...........\.....\ALUMUX.v

...........\.....\IDC.v

...........\.....\IR.v

...........\.....\mem.txt

...........\.....\mem2.txt

...........\.....\mem4.txt

...........\.....\PC.v

...........\.....\PIC.v

...........\.....\PIC_DEFINES.v

...........\.....\Progmemrom.v

...........\.....\RAM.v

...........\.....\STACK.v

...........\.....\testbench.v

...........\.....\testmada.v

...........\.....\Timing.v

...........\.....\transcript

...........\.....\vsim.wlf

...........\.....\work

...........\.....\....\@a@d@d@r@m@u@x

...........\.....\....\..............\verilog.asm

...........\.....\....\..............\_primary.dat

...........\.....\....\..............\_primary.vhd

...........\.....\....\@a@l@u

...........\.....\....\......\verilog.asm

...........\.....\....\......\_primary.dat

...........\.....\....\......\_primary.vhd

...........\.....\....\@a@l@u@m@u@x

...........\.....\....\............\verilog.asm

...........\.....\....\............\_primary.dat

...........\.....\....\............\_primary.vhd

...........\.....\....\@i@d@c

...........\.....\....\......\verilog.asm

...........\.....\....\......\_primary.dat

...........\.....\....\......\_primary.vhd

...........\.....\....\@i@r

...........\.....\....\....\verilog.asm

...........\.....\....\....\_primary.dat

...........\.....\....\....\_primary.vhd

...........\.....\....\@p@c

...........\.....\....\....\verilog.asm

...........\.....\....\....\_primary.dat

...........\.....\....\....\_primary.vhd

...........\.....\....\@p@i@c

...........\.....\....\......\verilog.asm

...........\.....\....\......\_primary.dat

...........\.....\....\......\_primary.vhd

...........\.....\....\@progmemrom

...........\.....\....\...........\verilog.asm

...........\.....\....\...........\_primary.dat

...........\.....\....\...........\_primary.vhd

...........\.....\....\@r@a@m

...........\.....\....\......\verilog.asm

...........\.....\....\......\_primary.dat

...........\.....\....\......\_primary.vhd

...........\.....\....\@s@t@a@c@k

...........\.....\....\..........\verilog.asm

...........\.....\....\..........\_primary.dat

...........\.....\....\..........\_primary.vhd

...........\.....\....\@timing

...........\.....\....\.......\verilog.asm

...........\.....\....\.......\_primary.dat

...........\.....\....\.......\_primary.vhd

...........\.....\....\@wreg

...........\.....\....\.....\verilog.asm

...........\.....\....\.....\_primary.dat

...........\.....\....\.....\_primary.vhd

...........\.....\....\tb

...........\.....\....\..\verilog.asm

...........\.....\....\..\_primary.dat

...........\.....\....\..\_primary.vhd

...........\.....\....\testmada

...........\.....\....\........\verilog.asm

...........\.....\....\........\_primary.dat

...........\.....\....\........\_primary.vhd

...........\.....\....\_info

...........\.....\Wreg.v

...........\pic

...........\...\FsrReg.v

...........\...\Idc.v

...........\...\IR.v

...........\...\MemorieProgram.V

...........\...\PC.v

...........\...\Pic.v

...........\...\progmem.txt

...........\...\Tb.v

...........\...\Test.V

...........\...\TestSemnale.v

...........\...\TimingGenerator.v

...........\...\work

...........\...\....\@fsr@reg

...........\...\....\........\verilog.asm

...........\...\....\........\_primary.dat

...........\...\....\........\_primary.vhd

...........\...\....\@i@r

...........\...\....\....\verilog.asm

...........\...\....\....\_primary.dat

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