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同步FIFO设计 用16*8
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syn_fifo 同步FIFO的
s_fifo 一个verilog
fifo 一个同步FIFO
fifo 同步FIFO( Ver
sfifo 此文件为同步FIFO
FPGA_FIFO 使用Veri
fpgafifo 基于fpga
fifo 同步FIFO 创建一个
fifo_syn 同步fifo并
fifo 这个是我自己写的同步
syn-fifo-verilog
sfifo verilog编写的
FifoAndTestbench
收藏
文件名称:simple_fifo
所属分类:
VHDL编程
资源属性:
上传时间:
2012-11-26
文件大小:
1kb
下载次数:
0次
提 供 者:
z**
相关连接:
无
下载说明:
别用迅雷下载,失败请重下,重下不扣分!
下载
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修正介绍说明
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verilog HDL原码
一种简单的同步FIFO原码,可以被综合-verilog HDL original code a simple synchronous FIFO original code, which can be integrated
相关搜索:
同步fifo
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