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文件名称:watch

  • 所属分类：
  • VHDL编程
  • 资源属性：
  • [VHDL] [源码]
  • 上传时间：
  • 2012-11-26
  • 文件大小：
  • 3kb
  • 下载次数：
  • 0次
  • 提 供 者：
  • not****
  • 相关连接：
  • 无
  • 下载说明：
  • 别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容均来自于网络，请自行研究使用

用FPGA实现带马表日历的电子表，verilog代码。-Using FPGA to achieve with digital watches stopwatch calendar, verilog code.
相关搜索： 电子表
calendar
verilog

(系统自动生成,下载前可以参看下载内容)

下载文件列表

watch

.....\CLKGEN.V

.....\COUNTER.V

.....\dataSel.v

.....\DECODER.V

.....\MUNIT.V

.....\TIMECTL.V

.....\TOP.V

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