文件名称:multiply
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这是我用verilog hdl语言写的浮点乘法器,用的是基4的booth算法,对于部分积使用了5-2压缩和3-2压缩,欢迎大家指点,也欢迎大家把它改成流水线以提高速度.
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压缩包 : 61549823multiply.rar 列表 download multiply\bootcoder.v download multiply\boot_mul.v download multiply\csa.v download multiply\tb_bootmul.v download multiply\tb_mul.v download multiply\_42c_l.v download multiply