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[VHDL编程S6_VGA

说明:利用cpld作为控制器实现驱动vga显示器,虽然只有8位色,但是实现方式只得借鉴-cpld verilog vga
<wphyl> 在 2025-01-21 上传 | 大小:3.1mb | 下载:0

[VHDL编程filter

说明:如何利用verilog设计数字滤波器 包含低通滤波器,带通滤波器,高通滤波器.-how to design a digit filter with Verilog
<jefferson> 在 2025-01-21 上传 | 大小:3.09mb | 下载:0

[VHDL编程VHDL_Sample

说明:VHDL VGA彩条发射器,里面有4个文件,分别是直接输出的,还有通过ROM查找颜色的,通过RAM和DRAM的-VHDL VGA color of the transmitter, there are 4 files, namely, direct output, as well as to find color by ROM, RAM and DRAM through the
<蔡灿> 在 2025-01-21 上传 | 大小:3.1mb | 下载:0

[VHDL编程verilog

说明:上海交通大学不错的verilog 教程。-Shanghai Jiaotong University, good verilog tutorial.
<徐金苟> 在 2025-01-21 上传 | 大小:3.09mb | 下载:0

[VHDL编程IEEE_Standard_verilog_std_1364_2005

说明:And here is the latest standard for you to read and use! everything for u!
<dmy> 在 2025-01-21 上传 | 大小:3.09mb | 下载:0

[VHDL编程nco

说明:基于FPGA的压控震荡器,可以通过震荡器来对输入信号进行有效的分频,而且是任意的分频系数都可以-FPGA-based VCO oscillator input signal, the effective frequency division and any sub-frequency coefficients can be
<zhou> 在 2025-01-21 上传 | 大小:3.09mb | 下载:0

[VHDL编程dds

说明:基于FPGA,利用vhdl语言结合matlab工具实现dds,已经仿真-Based on FPGA, VHDL language with matlab tools to achieve DDS, has simulation
<ljx> 在 2025-01-21 上传 | 大小:3.09mb | 下载:0

[VHDL编程asyn_fifo_bk

说明:该verilog代码位手动编写的异步fifo。-This code is manually generated asychronous fifo.
<江豪> 在 2025-01-21 上传 | 大小:3.1mb | 下载:0

[VHDL编程RT_Ethernet

说明:实时以太网MAC层协议控制器。注:100M全双工-Real-time Ethernet MAC layer protocol controller. Note: 100M full duplex
<罗文超> 在 2025-01-21 上传 | 大小:3.1mb | 下载:0

[VHDL编程sdram-uclinux

说明:使用最新的系统搭建工具Qsys构建了包括sdram的nios2系统,编写了程序,并在de2上实现。-This file is used to drive the sdram for qsys users.
<xiaofengyu> 在 2025-01-21 上传 | 大小:3.1mb | 下载:0

[VHDL编程hello

说明:FPGA最基础实验程序,编程实现向计算机发送“HELLO”字符串-FPGA most basic experimental procedures, programming sending " HELLO" string to the computer
<王小二> 在 2025-01-21 上传 | 大小:3.1mb | 下载:0

[VHDL编程FIFO_1

说明:利用FIFO模块实现不同时钟模块间的传输(The transmission between different clock modules is realized by using FIFO module)
<KING IN NORTH > 在 2025-01-21 上传 | 大小:3.1mb | 下载:0
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