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[VHDL编程] Carry_Select_Adder_Verilog
说明:进位选择加法器,verilog实现。包含3个TB。-Carry Select Adder. Verilog fulfilled. Three testbenches included.<张昊溢> 在 2025-02-02 上传 | 大小:3kb | 下载:0
[VHDL编程] 32_by_8_RAM
说明:32*8 RAM。Verilog实现。包含TB。-32 by 8 RAM. Testbench included.<张昊溢> 在 2025-02-02 上传 | 大小:3kb | 下载:0
[VHDL编程] lp_mng_top_rtl
说明:FPGA 控制lp_tlc5916 8路芯片LED 驱动控制器的VHDL代码实现。-FPGA lp_tlc5916 8-channel LED driver VHDL code.<murongyu> 在 2025-02-02 上传 | 大小:3kb | 下载:0
[VHDL编程] multi_4bits_pipelining
说明:实现4*4流水线乘法器的verilog源代码,在FPGA板上运行-4* 4 pipelined multiplier verilog source code, running on the FPGA board<麦涛涛> 在 2025-02-02 上传 | 大小:3kb | 下载:0