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文件名称:fenpin_odd

  • 所属分类：
  • VHDL编程
  • 资源属性：
  • [VHDL] [源码]
  • 上传时间：
  • 2013-04-01
  • 文件大小：
  • 3kb
  • 下载次数：
  • 0次
  • 提 供 者：
  • 陈
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  • 无
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如迅雷强制弹出，可右键点击选“另存为”。
失败请重下，重下不扣分。
修正介绍说明

介绍说明－－下载内容均来自于网络，请自行研究使用

verilog HDL写的6分频程序，通过48MHz晶振分出8MHz频率-6 divided by program Verilog HDL written separation of 8MHz frequency by 48MHz crystal oscillator
(系统自动生成,下载前可以参看下载内容)

下载文件列表





db\div_6.db_info

..\div_6.sld_design_entry.sci

div_6.qsf

div_6.v

div_6.v.bak

fenpin_odd.qpf

db

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