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[VHDL编程] test_mac_loopback
说明:用来测试MAC地址回环的VERILOG程序,可以继续完善它-Loop used to test the MAC address of the VERILOG program, you can continue to improve it<顾善昉> 在 2024-11-18 上传 | 大小:1kb | 下载:0
[VHDL编程] multiplier
说明:压缩的乘法器。是基于VERILOG 语言实现的,有较快的速度。-Compression of the multiplier. Is based on the VERILOG language, there is a faster speed.<hydan yi> 在 2024-11-18 上传 | 大小:1kb | 下载:0
[VHDL编程] FPGA-drive-12864
说明:FPGA驱动12864液晶,一般可以显示我们想显示的,只要相应的适当修改。-The FPGA drive, can generally 12864 LCD display we want to show, as long as the corresponding appropriate modification.<亮亮> 在 2024-11-18 上传 | 大小:1kb | 下载:0