[VHDL编程] IFCtrl.v

说明：dlx design的if模块，instruction fetch，stage 1-dlx design of if module, instruction fetch, stage 1
<Jeff> 在 2025-04-07 上传 | 大小：1kb | 下载：0

[VHDL编程] Mentor-Graphic-Tutorial.pdf

说明：mentor graphic 说明书2009版，英文教程，非常详细，版本较新-mentor graphic manual version 2009
<Jeff> 在 2025-04-07 上传 | 大小：4.8mb | 下载：0

[VHDL编程] flash

说明：该程序是一个FPGA中flash的烧写程序-The program is a flash in the FPGA programming burn
<安琪儿> 在 2025-04-07 上传 | 大小：11.15mb | 下载：0

[VHDL编程] 3jiekaihuanDAFIR

说明：采用开环DA的FIR滤波器，可以提高滤波器的速度，此程序为3个系数，4位输入的DA FIR滤波器的开环形式。-Open-loop DNA FIR filter, can improve the speed of the filter, the procedure for the three coefficients, open-ring form four inputs DA FIR filter.
<yang> 在 2025-04-07 上传 | 大小：1kb | 下载：0

[VHDL编程] iir_pipe

说明：此程序应用了流水线技术来实现IIR滤波器，它是由一个非递归部分和一个具有延迟为2和系数为9/16的递归部分构成。-The procedure applied to the pipeline techniques to achieve an IIR filter, which consists of a non-recursive portion and having a delay of 2 and a coefficient of t
<yang> 在 2025-04-07 上传 | 大小：1kb | 下载：0

[VHDL编程] duoxiangchouqu

说明：该程序采用多相分解方式实现的抽取器滤波器，该抽取器的运行速度要比向下采样器的通常FIR滤波器的速度快R倍。-The program uses polyphase decomposition way to achieve the decimation filter, the speed of the extractor runs faster than the down sampler of the FIR filter is gener
<yang> 在 2025-04-07 上传 | 大小：1kb | 下载：0

[VHDL编程] sinclvboqi

说明：该程序实现了sinc滤波器的分数延迟速率变换器，其中R = 0.75.-The program implements a sinc filter fractional delay rate converter, where R = 0.75.
<yang> 在 2025-04-07 上传 | 大小：1kb | 下载：0

[VHDL编程] farrow

说明：该程序实现多项式分数延迟（farrow）的设计。-The program polynomial fractional delay (farrow) design.
<yang> 在 2025-04-07 上传 | 大小：1kb | 下载：0

[VHDL编程] Mini-Risc-core

说明：这个源码是RISC型CPU处理器，正常动作，给很大帮助想做CPU处理器的人。-This is a Mini-RISC CPU/Microcontroller that is mostly compatible with the PIC 16C57 Microchip.
<金铁男> 在 2025-04-07 上传 | 大小：101kb | 下载：0

[VHDL编程] Low-Power-FIR-Filter

说明：FIR滤波在数字信号领域中很大作用。这个源码很大帮助VHDL工程师或学习者。里面包含说明书。-This report investigates the power consumption of digital arithmetic circuits for use in the design and implementation of a 15-tap programmable Finite Impulse Response (FIR)
<金铁男> 在 2025-04-07 上传 | 大小：427kb | 下载：0

[VHDL编程] DES_Triple-DES-IP-Cores

说明：Triple DES 密码算法。 利用Xillinx公司的Virtex-II芯片测试了。正常动作。-Triple DES core implementation in verilog. It takes three standard 56 bit keys and 64 bits of data as input and generates a 64 bit encrypted/decrypted result.
<金铁男> 在 2025-04-07 上传 | 大小：69kb | 下载：0

[VHDL编程] PS2_SOC1

说明：用Verilog 设计了PS2 键盘 模块。 在altera公司的Cyclone系列测试了。 正常动作。包含者 doc软件，说明了动作原理。-This is a state-machine driven serial-to-parallel and parallel-to-serial interface to the ps2 style keyboard interface.
<金铁男> 在 2025-04-07 上传 | 大小：81kb | 下载：0